IO缓冲
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N+缓冲层对PT-IGBT通态压降影响的研究
N+缓冲层设计对PT-IGBT器件特性的影响至关重要。文中利用Silvaco软件对PT-IGBT的I-V特性进行仿真。提取相同电流密度下,不同N+缓冲层掺杂浓度PT-IGBT的通态压降,得到了通态压降随N+缓冲层掺杂浓度变化的曲...
2013-11-12
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基于中间汇编的缓冲区溢出检测模型
提出一种基于中间汇编的缓冲区溢出检测模型,用于对可执行代码进行静态分析和检测。采用中间汇编形式可以使算法对硬件平台透明,增强代码可阅读性,有利于对缓冲区溢出的检测。针对不安全函数调用和写内存循环2 种
2024-01-14
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7438 TTL开路输出2输入端四与非缓冲器
This device contains four independent gates each of whichperforms the logic NAND function. Th
2024-02-23
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7439 TTL开路输出2输入端四与非缓冲器
This device contains four independent gates with two datainputs, each which performs the logi
2024-05-08
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CY2305和CY2309作为PCI和同步动态RAM的缓冲器
A zero delay buffer is a device that can fan out 1 clock signal into multiple clock signals with zer
2023-12-14
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波特率可变;中断方式接收、发送;收发独立8字节缓冲区;可选择是否在满缓冲区后丢弃数据
波特率可变;中断方式接收、发送;收发独立8字节缓冲区;可选择是否在满缓冲区后丢弃数据
2014-01-11
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缓冲区溢出攻击的原理和防范技术分析
基于解决缓冲区溢出这一普遍发生的网络安全漏洞的目的,通过软件、硬件技术层面的验证方法,结合人工检查、静态发现技术、动态防御技术等实验手段,得出了在向缓冲区中传输数据时可以通过数组边界检
2013-10-30
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