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压缩工程

针对商业加密引擎中硬件资源和电路性能平衡问题，提出一种基于AES的低成本可重构的高速加密引擎的设计方案。该方案在AES加密算法的基础上，根据FPGA内在的结构特点，利用VHDL语言对其加密模块进行描述

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