HDL+Testing

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HDL+Testing 热门资料

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Verilog HDL编写的总线功能模型，十分有用，需要的下载

2013-12-20 58 HDL+Testing

Verilog HDL是一种硬件描述语言，用于从算法级、门级到开关级的多种抽象设计层次的数字系统建模，想学习的这个资料对你有用。

2015-09-02 117 HDL+Testing

LVDS的应用的Verilog HDL例子程序，由altera公司提供。

2013-12-31 163 HDL+Testing

2013-12-02 122 HDL+Testing

周立功Verilog HDL黄金参考指南，学习VerriLog的东西。

2014-01-17 126 HDL+Testing

verilog HDL语言编写的数字秒表，仿真已经通过，可供参考

2013-12-19 181 HDL+Testing

用于FPGA的huffman算法的HDL编码，包括VHDL及Verilog代码。可用于JPEG及MPEG压缩算法。

2016-09-19 80 HDL+Testing

基于Verilog-HDL语言的时钟设计这是一份非常不错的资料，欢迎下载，希望对您有帮助！

2021-12-20 3 HDL+Testing