GY-32

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·摘要：  采用自项向下的流程设计了一款32住DSP的cache.该cache采用两级结构,第一级采用哈佛结构,第二级采用普林斯顿结构.本文详细论述了该cache的结构设计及采用的算法.  

2024-08-31 5 GY-32

Verilog HDL语言中虽然有除的运算指令，但是除运算符中的除数必须是2的幂，因此无法实现除数为任意整数的除法，很大程度上限制了它的使用领域。并且多数综合工具对于除运算指令不能综合出令人满意的结果，有些甚至不能给予综合。对于这种情况，一...

2025-02-25 10 GY-32

用汇编语言写的32位计算器，代码里注释比较详细。文件为asm，需在dos编译。已通过编译。大二的计算机原理project，三个日夜的辛苦结果～

2015-06-13 37 GY-32