GPIF FIFO
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源代码 7,139
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异步FIFO控制器的设计 主要用于异步先进先出控制器的设计。 所用语言Verilog HDL.
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任意时钟配比的异步fifo.含有synplify ip库中的双端口ram。用于处理多时钟域问题。
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VC5416 对USB寄存器的读／写、配置； VC5416 对 USB的 FIFO 的操作； VC5416 对 USB的 setup 包的操作； VC5416 对 USB的 Endpointo
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介绍大型Cypress公司FIFO器件的内部工作和如何应用这些器件进行深度和宽度的扩展
This application note explains the internal operation of the large FIFOs manufactured by Cypress and...