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FPGA+PCI9054，源码，下载有用，欢迎下载

2022-11-14 4 FPGA+Edit

fpga verilog 实现UART源码本人调试过，可以使用，程序简单明了占用资源少

2023-03-06 8 FPGA+Edit

介绍FPGA 设计时序收敛方面知识的PPT

2024-05-19 6 FPGA+Edit

异步FIFO是一种先进先出的电路，使用在需要产时数据接口的部分，用来存储、缓冲在两个异步时钟之间的数据传输。在异步电路中，由于时钟之间周期和相位完全独立，因而数据的丢失概率不为零。如何设计一个高可靠性、高速的异步FIFO电路便成为一个难点。...

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fpga verilog 模拟uart收发器，已在最高波特率115200下测试通过

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自己写的二进制编辑器．二进制阅读器．类似于ultra Edit. 功能：decimal,hexadecimal,char: 十进制显示，十六进制显示．字符串显示．十进制查找，十六进制查找．字符串查找．十进制替换，十六进制替换．字符串...

2016-05-19 128 FPGA+Edit

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