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fpga时钟，vhdl，带设置时分秒，暂停，复位功能

2025-05-11 10 FPGA+Radar

fpga的verilog语言的测试，各个开发步骤的实验。能够正常编译。适合初学者

2025-06-01 4 FPGA+Radar

用来通过数码管显示时间，有暂停开始复位的功能

2025-06-04 5 FPGA+Radar

fpga例程代码，以前用过的感觉挺好的，给大家分享下

2025-06-07 9 FPGA+Radar

一直以来都想写点什么，关于FPGA设计，因为有点不太服气。为什么同样是设计，有些人可以好像玩一样的摆弄，photoshop，很时尚，很践。有些人可以用所谓的广告创意玩弄人们的智商。而硬件工程师则一律的被人以为呆板没有创意。我是说，为什么我们...

2022-08-12 8 FPGA+Radar