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简述了数字滤波器中的有限冲击响应(FIR) 滤波器原理 ,对 FIR 滤波器的窗函数设计方法进行了研究 ,并给出了仿真结果。
·FIR滤波器的设计及DSP实现
·基于DSP_Builder的FIR滤波器的设计
8阶对称系数并行FIR滤波器(verilog)用作数字滤波,系数可调。根据实际截止频率决定。
DSP6000实现的FIR滤波的算法程序。
FIR滤波器包括所有的源程序
FIR滤波器的行为级VHDL源代码,可以任意修改滤波器级数,滤波器系数的精度为16比特。
C5000下的FIR 滤波器汇编源程序,仅供参考
VHDL语言编写的FIR滤波器源码\r\n对于嵌入式设计者有很好的指导作用\r\n
基于FPGA的FIR数字滤波器算法研究与设计实现
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