《Verilog HDL 语言编程》 异步FIFO设计（基于Verilog)
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FIFO Queue技术资料
资源总数：458
FIFO Queue全部资料 (458个)
采用EZ-USB GPD开发的USB FIFO测试程序
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fpga从FIFO读数据并上传到双口ram中。
fpga从FIFO读数据并上传到双口ram中。...
利用一个SAM设计一个FIFO 的存储器
利用一个SAM设计一个FIFO 的存储器...
这是我以前写的一个Fifo的一个类
这是我以前写的一个Fifo的一个类，有需要的可以参照一下！...
VHDL的ram和fifo model code 包含众多的厂家
VHDL的ram和fifo model code 包含众多的厂家...
异步FIFO的设计 包括testbench 已调试成功
异步FIFO的设计 包括testbench 已调试成功...
A badic controller for the UART. It incorporates a -- transmit and receive FIFO (fr
A badic controller for the UART. It incorporates a -- transmit and receive FIFO (fr...
用SmartGen生成一个256*8的大小同步FIFO
用SmartGen生成一个256*8的大小同步FIFO，并通过串口发送数据初始化FIFO。然后，再通过串口返回到上位机的串口调试程序显示，确认数据是否正确。...
提出了利用fifo,实现dsp之间的高速、实时、可靠的数据传输,介绍了fifo原理及性能特点
提出了利用fifo,实现dsp之间的高速、实时、可靠的数据传输,介绍了fifo原理及性能特点，详细阐述了系统的硬 件接口电路及软件设计。...