IP core of adder,8-bit width, three design concerpts with different effect.
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日本北斗電子製 TCP/IP+Ethernet网络机器设计法
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利用FIFO数据结构,在8051单片机上实现全双工通讯,实现MODBUS通讯协议
高速FIFO,verilog设计。速度高达130Mhz
基于Avalon的SDRAM控制器IP核
关于异步FIFO的代码,使用VHDL语言写的,很不错
linux环境下的tcp/ip socket编程
取得客户端真实IP地址(透过代理取得真实地址)