FIFO+IP

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FIFO级联，利用verilog语言实现Xilinx FIFO18单元的多个级联，增大FIFO深度。

2017-01-28 171 FIFO+IP

解析硬件FIFO的核心工作机制，基于同步与异步设计逻辑，展示数据缓冲与流控的实现方式。采用标准数字电路设计方法，适合从事嵌入式开发与系统架构的工程师参考。

2026-01-09 2 FIFO+IP

FIFO程序，适用FPGA仿真的代码，有一定的价值

2014-01-20 47 FIFO+IP

VHDL Test Bench created by HDL Bencher 1.02 -- Mon Feb 05 11:59:49 2001 LIBRARY ieee; USE ieee.std_logic_1164.all;...

2025-11-18 1 FIFO+IP

一种简单的异步FIFO设计代源码，实现非常灵活。

2025-06-09 1 FIFO+IP

讲述异步FIFO结构，非常的详细哦。。。

2025-04-09 9 FIFO+IP