1.1 问题产生的环境1.1.1 软件环境1. PC机的系统为Microsoft Window XP Professional版本2002 Service Pack 2；2. Quartus II V7.0软件，并安装了MegaCore IP V7.0；3. NiosII IDE 7.0软件。1.1.2 硬件环境核心板的芯片是EP2C35F672C8N的MagicSOPC实验箱的硬件系统。硬件的工作环境是在普通的环境下。1.2 问题的现象在使用MagicSOPC实验箱的光盘例程时，使用Quartus II编译工程时出现编译错误，错误提示信息如图1.1、图1.2所示。
上传时间： 2013-11-18
上传用户：zhyiroy
quartus
上传时间： 2014-01-13
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02_Quartus II时序优化策
上传时间： 2013-10-15
上传用户：wlcaption
基于FPGA数字电压表的设计 EDA是电子设计自动化（Electronic Design Automation）的缩写，在20世纪60年代中期从计算机辅助设计（CAD）、计算机辅助制造（CAM）、计算机辅助测试（CAT）和计算机辅助工程（CAE）的概念发展而来的。 EDA技术就是以计算机为工具，设计者在EDA软件平台上，用硬件描述语言VHDL完成设计文件，然后由计算机自动地完成逻辑编译、化简、分割、综合、优化、布局、布线和仿真，直至对于特定目标芯片的适配编译、逻辑映射和编程下载等工作。本电压表的电路设计正是用VHDL语言完成的 。此次设计采用的是Altera公司 的Quartus II 7.0软件。本次设计的参考电压为2.5V，精度为0.01V。此电压表的设计特点为通过软件编程下载到硬件实现，设计周期短，开发效率高。
上传时间： 2013-10-22
上传用户：Shaikh
QuartusII中利用免费IP核的设计 作者：雷达室 以设计双端口RAM为例说明。 Step1：打开QuartusII，选择File—New Project Wizard，创建新工程，出现图示对话框，点击Next；
上传时间： 2013-10-18
上传用户：909000580
帮你解决quartus ii12.0 的破解问题
上传时间： 2013-11-03
上传用户：子虚乌有
Nios II定制指令用户指南：With the Altera Nios II embedded processor, you as the system designer can accelerate time-critical software algorithms by adding custom instructions to the Nios II processor instruction set. Using custom instructions, you can reduce a complex sequence of standard instructions to a single instruction implemented in hardware. You can use this feature for a variety of applications, for example, to optimize software inner loops for digital signal processing (DSP), packet header processing, and computation-intensive applications. The Nios II configuration wizard,part of the Quartus® II software’s SOPC Builder, provides a graphical user interface (GUI) used to add up to 256 custom instructions to the Nios II processor. The custom instruction logic connects directly to the Nios II arithmetic logic unit (ALU) as shown in Figure 1–1.
上传时间： 2013-10-12
上传用户：kang1923
《Altera FPGA工程师成长手册》以altera公司的fpga为例，由浅入深，全面、系统地详细讲述了基于可编程逻辑技术的设计方法。《Altera FPGA工程师成长手册》讲解时穿插了大量典型实例，便于读者理解和演练。另外，为了帮助读者更好地学习，《Altera FPGA工程师成长手册》提供了配套语音教学视频，这些视频和《Altera FPGA工程师成长手册》源代码一起收录于《Altera FPGA工程师成长手册》配书光盘中。 《Altera FPGA工程师成长手册》涉及面广，从基本的软件使用到一般电路设计，再到nios ⅱ软核处理器的设计，几乎涉及fpga开发设计的所有知识。具体内容包括：eda开发概述、altera quartus ii开发流程、altera quartus ii开发向导、vhdl语言、基本逻辑电路设计、宏模块、lpm函数应用、基于fpga的dsp开发设计、sopc系统构架、soc系统硬件开发、sopc系统软件开发、nios ii常用外设、logiclock优化技术等。
上传时间： 2015-01-01
上传用户：123啊
eda必下。。
上传时间： 2013-11-16
上传用户：杏帘在望
本文采用Altera公司的FPGA器件Cyclone III系列EP3C10作为核心器件构成了R-S（255，223）编码系统；利用Quartus II 9.0作为硬件仿真平台，用硬件描述语言Verilog_HDL实现编程，并且通过JTAG接口与EP3C10连接。R-S（Reed-Solomon）码是一类纠错能力很强的特殊的非二进制BCH码，能应对随机性和突发性错误，广泛应用于各种通信系统中和保密系统中。R-S（255，223）码能够检测32字节长度和纠错16字节长度的连续数据错误信息。
标签： CycloneIII RS编码
上传时间： 2013-10-08
上传用户：yuchunhai1990
