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用VHDL编写的一个出租车计费器
用VHDL编写的一个出租车计费器，起步6元计2公里，此后每半公里计0.8元，停车等待每2.5分计0.8元。通过仿真，但未下载到CPLD测试
2016-06-18
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基于FPGA的出租车计费器设计.rar
本文介绍了一种采用单片FPGA 芯片进行出租车计费器的设计方法，主要阐述如何使用新兴的EDA 器件取代传统的电子设计方法，利用FPGA 的可编程性，简洁而又多变的设计方法，缩短了研发周期，同时使出租车计费器体积更小功能更强大。本设计不仅实现...
2023-10-07
1
基于FPGA的出租车计费器的实现
介绍了出租车计费器系统的组成及工作原理，简述了在EDA平台上用单片CPLD器件构成该数字系统的设计思想和实现过程。论述了车型调整模块、计程模块、计费模块、译码动态扫描模块等的设计方法与技巧。
2024-03-20
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出租车计费器的EDA设计与实现
以现场可编程逻辑器件(FPGA) 为设计载体， 以硬件描述语言(VHDL) 为主要表 达方式， 以QuartusⅡ开发软件和GW48EDA开发系统为设计工具， 给出了一种出租车计费器 的工作原理和软硬件实现方法。同时对该出租车计费器进行...
2024-05-02
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