CPLD的VerilogHDL总线代码,在EPM7128SLC84-10+Quartus4平台上运行通过.
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基于CPLD-FPGA的半整数分频器的设计,用于设计EDA...
JTAG CPLD实现源代码,比用简单并口调试器快5倍以上。\r\n以前总觉得简单的并口jtag板速度太慢,特别是调试bootloader的时候,简直难以忍受。最近没什么事情,于是补习了几天vhdl,用cpld实现了一个快速的jtag转换板。cpld用epm7128stc100-15,晶振20兆,t...
cpld与单片机接口设计,利于电子设计及应用...
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