DDS-PLL

This example sets up the PLL in x10/2 mode, divides SYSCLKOUT by six to reach a 25Mhz HSPCLK (assuming a 30Mhz XCLKIN). ...

2014-01-25 185 DDS-PLL

0114、PLL电路的研究及在信号产生中的应用论文资料

2014-04-09 123 DDS-PLL

2013-12-23 90 DDS-PLL

2016-12-17 171 DDS-PLL

2017-04-04 104 DDS-PLL

设计采用Altera公司CycloneII系列EP2C5Q208作为核心器件，采用直接数字频率合成技术实现了一个频率、相位可控的基本信号发生器。该信号发生器可以产生正弦波、方波、三角波和锯齿波四种波形。仿真及硬件验证的结果表明，该信号发生器...

2013-11-10 79 DDS-PLL

设计采用Altera公司CycloneII系列EP2C5Q208作为核心器件，采用直接数字频率合成技术实现了一个频率、相位可控的基本信号发生器。该信号发生器可以产生正弦波、方波、三角波和锯齿波四种波形。仿真及硬件验证的结果表明，该信号发生器...

2013-12-18 138 DDS-PLL

　　本设计基于DDS原理和FPGA技术按照顺序存储方式，将对正弦波、方波、三角波、锯齿波四种波形的取样数据依次全部存储在ROM波形表里，通过外接设备拨扭开关和键盘控制所需波形信号的输出，最终将波形信息显示在LCD液晶显示屏上。各硬件模块之间...

2013-11-09 80 DDS-PLL

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