DDS-PLL

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DDS-PLL 热门资料

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设计了基于DDS的低通滤波器设计，技术指标：截止频率120MHz，通带内的衰减为0.2dB，在135MHz处的衰减为66dB。

2025-06-13 7 DDS-PLL

难得一见的AD9913完整应用笔记，涵盖其可编程模数架构与基于累加器的DDS实现细节。技术文档深入解析信号生成机制与配置方法，适合射频与通信系统开发人员参考。

2026-01-05 3 DDS-PLL

本文采用Altera公司的ACEXIK系列FPGA(现场可编程门阵列)器件，在一个FPGA器件中就可以很方便地实现相位累加器和波形查找表。使用VHDL(甚高速集成电路硬件描述语言)在QuartusII工具软件的环境中进行设计

2026-03-17 1 DDS-PLL

文章利用LC7218 PLL频率合成器在AV领域的电调谐功能,提出了一个TV/FM/AM全景接收机设计方案,重点设计分析了LC7218与单片机之间的I/O数据结构,显示了它优良的性能.

2024-10-11 8 DDS-PLL

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