DDS-FPGA

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设计了基于DDS的低通滤波器设计，技术指标：截止频率120MHz，通带内的衰减为0.2dB，在135MHz处的衰减为66dB。

2025-06-13 7 DDS-FPGA

摘要： 本文主要介绍的是微型的DDS信号发生器的原理和设计，整个系统是以AT89S51为控制，外部ROM为存储，AD9850芯片和温度补偿晶体振荡器构成的微型DDS信号发生器，采用DM-162点阵液晶显示模块作为显示器。该软件系统采用4*...

2024-03-18 2 DDS-FPGA