DDS+8IP
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用verilog编写的高速8路并行dds模块
用verilog编写的高速8路并行dds模块,用于与高速da(1ghz或以上)接口产生任意频率正弦波,模块已经经过工程验证,用于产品中。
2014-01-04
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基于ATMEGA16和DDS的信号发生器的代码
基于ATMEGA16和DDS的信号发生器的代码,内含一个基于IAR集成开发环境的工程,可直接用IAR打开,编译并烧入单片机,是本人花了半个月的一个成果
2013-12-17
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FPGA直接数字频率合成器(DDS)的设计
想要快速实现高精度信号生成?本资源提供完整的FPGA DDS设计,涵盖相位累加、波形查找与输出控制,适用于通信与测控场景。直接可用,提升开发效率。
2026-01-19
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