ASIC对产品成本和灵活性有一定的要求.基于MCU方式的ASIC具有较高的灵活性和较低的成本,然而抗干扰性和可靠性相对较低,运算速度也受到限制.常规ASIC的硬件具有速度优势和较高的可靠性及抗干扰能力,然而不是灵活性较差,就是成本较高.与传统硬件(CHW)相比,具有一定可配置特性的场可编程门阵列(FPGA)的出现,使建立在可再配置硬件基础上的进化硬件(EHW)成为智能硬件电路设计的一种新方法.作为进化算法和可编程器件技术相结合的产物,可重构FPGA的研究属于EHW的研究范畴,是研究EHW的一种具体的实现方法.论文认为面向分类的专用类可重构FPGA(ASR-FPGA)的研究,可使可重构电路粒度划分的针对性更强、设计更易实现.论文研究的可重构FPGA的BCH通讯纠错码进化电路是一类ASR-FPGA电路的具体方法,具有一定的实用价值.论文所做的工作主要包括:(1)BCH编译码电路的设计——求取实验用BCH码的生成多项式和校验多项式及其相应的矩阵并构造实验用BCH码;(2)建立基于可重构FPGA的基核——构造具有可重构特性的硬件功能单元,以此作为可重构BCH码电路的设计基础;(3)构造实现可重构BCH纠错码电路的方法——建立可重构纠错码硬件电路算法并进行实验验证;(4)在可重构纠错码电路基础上,构造进化硬件控制功能块的结构,完成各进化RLA控制模块的验证和实现.课题是将可重构BCH码的编译码电路的实现作为一类ASR-FPGA的研究目标,主要成果是根据可编程逻辑电路的特点,选择一种可编程树的电路模型,并将它作为可重构FPGA电路的基核T;通过对循环BCH纠错码的构造原理和电路结构的研究,将基核模型扩展为能满足纠错码电路需要的纠错码基本功能单元T;以T作为再划分的基本单元,对FPGA进行"格式化",使T规则排列在FPGA上,通过对T的控制端的不同配置来实现纠错码的各个功能单元;在可重构基核的基础上提出了纠错码重构电路的嵌套式GA理论模型,将嵌套式GA的染色体串作为进化硬件描述语言,通过转换为相应的VHDL语言描述以实现硬件电路;采用RLA模型的有限状态机FSM方式实现了可重构纠错码电路的EHW的各个控制功能块.在实验方面,利用Xilinx FPGA开发系统中的VHDL语言和电路图相结合的设计方法建立了循环纠错码基核单元的可重构模型,进行循环纠错BCH码的电路和功能仿真,在Xilinx公司的Virtex600E芯片进行了FPGA实现.课题在研究模型上选取的是比较基本的BCH纠错码电路,立足于解决基于可重构FPGA核的设计的基本问题.课题的研究成果及其总结的一套ASR-FPGA进化硬件电路的设计方法对实际的进化硬件设计具有一定的实际指导意义,提出的基于专用类基核FPGA电路结构的研究方法为新型进化硬件的器件结构的设计也可提供一种借鉴.
上传时间： 2013-07-01
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NT6008是继PI SC0163D之后一颗能兼容USB智能识别的QC3.0识别芯片，打破了支持苹果识别就不能通过高通QC3.0认证的传言。 联系人：唐云先生（销售工程） 手机：13530452646(微信同号) 座机：0755-33653783 （直线） Q Q: 2944353362
上传时间： 2019-03-18
上传用户：lryang
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标签： NT6008D QC3.0快充协议识别IC
上传时间： 2019-03-18
上传用户：lryang
IP2723T 是一款集成多种协议、用于 USB 输出 端口的快充协议 IC。支持多种快充协议，包括 USB TypeC DFP ， PD2.0/PD3.0/PPS , HVDCP QC4/QC4+/QC3.0/QC2.0 （ Quick Charge ）， FCP （Hisilicon® Fast Charge Protocol），SCP（Super Fast Charge），AFC（Samsung® Adaptive Fast Charge）， MTK PE+ 2.0/1.1（MediaTek Pump Express Plus 2.0/1.1），Apple 2.4A，BC1.2 以及三星 2.0A。为适 配器、车充等单向输出应用提供完整的 TYPE-C 解决 方案。
标签： IP2723
上传时间： 2022-03-04
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IP2326 集成功率MOS，采用同步开关架构，使其在应用时仅需极少的外围器件，并有效减小整体方案的尺寸，降低BOM 成本。
上传时间： 2022-03-05
上传用户：trh505
AXP221 是一款高度集成的电源系统管理芯片，针对单芯锂电池 ( 锂离子或锂聚合物 ) 且需要多路电源转换输出的应用，提供简单易用而又可以灵活配置的完整电源解决方案，充分满足多核应用处理器系统对于电源相对复杂而精确控制的要求 。
上传时间： 2022-04-08
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IP2716是一款集成USB TYPE-C输入输出协议、USB Power Delivery（PD3.0）输入输出协议、QC3.0/2.0输出快充协议（兼容DCP识别功能，兼容BC1.2、苹果和三星手机）等多功能。高集成度与丰富功能，使其在应用时仅需极少的外围器件。如果原有的普通方案输出功率和输出电压范围满足需求，只需额外增加外扩的功率MOS就可以实现在原有方案的基础上升级为支持TYPE-C、PD3.0、QC3.0/2.0的高级快充方案。适当提升DC-DC或AC-DC元件性能，可以轻松实现最高100W（20V 5A）输出能力，为移动电源、适配器、车充提供完整的TYPE-C解决方案。
标签： ip2716
上传时间： 2022-04-09
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目前的蓝牙耳机非常常见，各种厂商都生产有蓝牙芯片，其中BK上海博通是一种国产的芯片，非常多的应用在各种廉价蓝牙耳机解决方案，然而网上博通的资料比较少，下面是一些简单的介绍。BK3266是一个低功耗，高度集成的蓝牙系统芯片(SoC)音频设备。它集成了高性能的蓝牙射频收发器、功能丰富的基带处理器、闪存控制器、多个模拟和数字外围设备，以及一个包含蓝牙软件栈的系统。播放音频、语音和SPP配置文件。基于缓存的体系结构使SIP8M闪存设备具有完全的可编程性，并可用于控制和多媒体混合应用程序。内双立体声模数转换器可以用数字均衡器处理的数字信号的TS立体模拟输入。该装置结合了片上电源管理与线性和开关模式降压调节器，还包括220 mA内部电池充电控制器，以进一步降低外部材料清单(Bom)成本。BK3266特性：工作电压为2.8V至4.2VA2DP平均电流9mA300 UA，500 ms嗅觉电流0.8uA深睡眠电流蓝牙4.2经典和低功耗A2DP v1.3、AVRCP v1.6、HFP v1.7、HID V1.1、AVCTP v1.4、AVDTP v1.3和SPP v1.2真正的无线立体声和两个主动链路双线UART下载接口16位立体声ADC和DAC立体声输入和双麦克风五带数字硬件均衡器SPI，UART，I2C，SDIO和USB具有MCLK输出的I2S主从接口外部PA和LNA接口最多220mA电池充电控制器
上传时间： 2022-06-02
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对于现有无线充电产品，无需更改原有方案电路，即可实现支持PD适配器快充功能
上传时间： 2022-06-25
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本文分析了当代高精度地震勘探数据采集系统的发展现状，研究了数据采集的A/D方法及理论、现场可编程门阵列(Field Programmable GateArray，FPGA)技术的发展及原理，串口通信的原理及实现。在此基础上，探讨了采用FPGA控制24位△∑模数转换器来实现高精度地震勘探数据采集系统的实现思路，对探测传感器或检波器后端数据采集系统的信号A/D转换、FPGA与外部接口设计、串口数据通信做了详细的研究，尤其是在用FPGA来完成与外部ADC的接口控制上做了深入的开发和设计，整个接口控制模块采用VHDL语言编写，并同时将ROM、FIFO等数字逻辑模块一起集成到一片FPGA芯片当中，并在Quartus Ⅱ6.0的开发平台上通过了软件仿真，时序仿真结果达到了系统要求。
上传时间： 2013-05-21
上传用户：yuele0123
