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CPLD+VHDL

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基于vhdl的数字钟有闹钟,秒表,时钟,日期等功能秒表可以开始,暂停,清零, 时钟可以设置时间, 还可以设置日期

基于vhdl的数字钟有闹钟,秒表,时钟,日期等功能秒表可以开始,暂停,清零, 时钟可以设置时间, 还可以设置日期

2013-12-20 173 CPLD+VHDL

利用汇编语言编写,VHDL,实现PWM波形转换电压,直接导入单片机即可运行,产生波形输出实现转换电压的功能.

利用汇编语言编写,VHDL,实现PWM波形转换电压,直接导入单片机即可运行,产生波形输出实现转换电压的功能.

2014-01-12 31 CPLD+VHDL

4位数值比较器MC14585B.能够将两个输入信号比较的各种情况送到输出端口上.本程序基于VHDL语言,开发环境是MAXPLUS2

4位数值比较器MC14585B.能够将两个输入信号比较的各种情况送到输出端口上.本程序基于VHDL语言,开发环境是MAXPLUS2

2016-03-09 28 CPLD+VHDL

本人现在用的TDS510 DSP仿真器的资料,准备过段时间自己做一个,里面包括VHDL程序和原理图.有兴趣可以研究一下.

本人现在用的TDS510 DSP仿真器的资料,准备过段时间自己做一个,里面包括VHDL程序和原理图.有兴趣可以研究一下.

2014-11-09 161 CPLD+VHDL

自己做的VHDL交通灯控制器；分频器、信号控制器、时钟模块；EDA；通过了仿真、运行。时间可以设置为随意的两位数.

自己做的VHDL交通灯控制器；分频器、信号控制器、时钟模块；EDA；通过了仿真、运行。时间可以设置为随意的两位数.

2017-08-10 39 CPLD+VHDL

针对多DSP 共享总线的通用信号处理板卡, 介绍了基于PCI9054 和CPCI 总线的接口设计, 分析了通用WDM总线驱动程序的开发。采用Verilog HDL 用CPLD 设计控制时序实现了DS

针对多DSP 共享总线的通用信号处理板卡, 介绍了基于PCI9054 和CPCI 总线的接口设计, 分析了通用WDM总线驱动程序的开发。采用Verilog HDL 用CPLD 设计控制时序实现了DSP 和 CPCI 总线桥接器PCI90...

2013-12-24 161 CPLD+VHDL

摘要探讨了IP 核的验证与测试的方法及其和 VHDL语言在 IC 设计中的应用并给出了其在RISC8 框架 CPU 核中的下载实例．

摘要探讨了IP 核的验证与测试的方法及其和 VHDL语言在 IC 设计中的应用并给出了其在RISC8 框架 CPU 核中的下载实例．

2014-07-11 92 CPLD+VHDL

vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波（A、B）的频率、幅度可控输出（方波 A的占空比也是可控的）

vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波（A、B）的频率、幅度可控输出（方波 A的占空比也是可控的），可以存储任意波形特征数据并能重现该波形，还可完成各种波形的线形叠加输出。

2015-07-10 155 CPLD+VHDL