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CPLD+VHDL

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rijndael算法的一个vhdl语言编写的程序,可供学习者参考交流

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2014-01-09 41 CPLD+VHDL

一个有效位为4位的十进制的数字频率计,VHDL语言编写

一个有效位为4位的十进制的数字频率计,VHDL语言编写，已在硬件实验箱上实验通过。

2013-12-22 141 CPLD+VHDL

用ISE开发的VHDL随机地址发生器,采用循环计数生成地址

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2013-12-21 106 CPLD+VHDL

好书推荐之VHDL经典实用教程中文版（相当不错的教材）@arthurday

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2015-06-30 110 CPLD+VHDL

一个很好的VHDL实现的功能模块程序,希望你可以用的上!

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2015-07-01 61 CPLD+VHDL

介绍怎样利用VHDL语言来实现一个多周期的处理器核心

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2013-12-20 78 CPLD+VHDL

使用VHDL設計一個適用於ETSI OFDM的時間和頻率同步處理器

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2015-09-21 120 CPLD+VHDL

基于VHDL的POC接口控制器,用于CPU与打印机间的数据控制

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2015-09-24 187 CPLD+VHDL