CPLD+VHDL

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基于VHDL语言的一个简单秒表 基于VHDL语言的一个简单秒表

2023-09-13 1 CPLD+VHDL

2025-04-18 2 CPLD+VHDL

基于VHDL的8位除法器的实现,The Design of 8 Division With VHDL

2025-05-10 7 CPLD+VHDL

在eda课程设计中要求用VHDL语言设计一个数字秒表源码及课题报告如下

2025-05-13 6 CPLD+VHDL

本程序通过8路信号，实现实时按键值的检测，并可以连接到数码显示模块

2023-11-04 8 CPLD+VHDL

在Quartus II 9.0环境下编写的VHDL代码，实现二分频、三分频、四分频功能。

2023-11-28 4 CPLD+VHDL

用vhdl语言，在ZY11EDA13BE型实验箱，实验了8位的串行密码锁的功能

2023-06-15 9 CPLD+VHDL

伴随高速DSP技术的广泛应用，实时快速可靠地进行数字信号处理成为用户追求的目标。同时，由于可编程器件在速度和集成度方面的飞速提高，使得利用硬件实现数字信号实时快速可靠处理有了新的途径。 FIR滤波器是数字信号处理中常用部件，它的最大优点在于...

2023-06-24 3 CPLD+VHDL