CPLD+VHDL

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用vhdl的4x4的数据选择器，在maxplusII下编译、仿真通过。是构成大型数字电路的重要部件。适合vhdl初学者分析学习。

2015-04-13 136 CPLD+VHDL

这是有关VHDL的一些范例，可以通过范例学习一点东西，巩固自己学过的东西

2013-12-11 186 CPLD+VHDL

用VHDL语言编写的FFT程序，有些参考价值哦

2013-12-20 131 CPLD+VHDL

用vhdl实现24小时计数器，方法简单实用。仿真环境MAXPLUS-

2013-12-27 193 CPLD+VHDL

程序用VHDL实现：频率合成，DDS 主要调用LPM

2015-04-06 128 CPLD+VHDL

我上期做的VHDL设计方案，用于在FPGA或CPLD中实现HDB3的编码

2015-03-10 110 CPLD+VHDL

这是一个VHDL写的FIR模块，我的编译环境是QuartusII 5.0

2015-05-04 65 CPLD+VHDL

vhdl练习实例。在maxplus2中编写，编译通过，正确。

2015-05-10 161 CPLD+VHDL