CPLD+VHDL

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2014-01-21 170 CPLD+VHDL

这份vhdl电子钟实验报告专为初学者设计，提供了从基础到进阶的详细指导。尽管仿真结果存在轻微抖动，但通过调整时间周期即可轻松解决。经过实际项目验证的代码和步骤，帮助你快速掌握vhdl编程与数字电路设计。

2025-12-20 3 CPLD+VHDL

十六进制的七段数码管的现实，在硬件实验中通过开关控制可以显示从0到F的十六进制数

2025-12-25 2 CPLD+VHDL

基于vhdl的数字钟，可以清零，置数，闹钟功能

2017-07-26 3 CPLD+VHDL

设计一个fir滤波器，并仿真测试其功能

2017-09-18 1 CPLD+VHDL

vhdl 写的 PCI IP核程序，已经过测试

2014-09-09 123 CPLD+VHDL

2013-12-24 40 CPLD+VHDL

vhdl 模块对nand flash控制，实现了FPGA对NAND FLASH直接读写控制。

2013-12-14 47 CPLD+VHDL