CPLD+VHDL
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CPLD+VHDL 热门资料
查看全部 500 份 →基于ARM9 和CPLD 的输入输出系统设计
介绍了一种基于ARM9 和CPLD 架构的嵌入式输入输出系统的软硬件设计。系统以工业级EP9315 为核心，扩展了LCD、触摸屏、以太网、串口和USB 等控制接口；以MAX2_EPM240为核
2024-01-13
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利用单片机实现CPLD的在系统编程
为了获得一定的灵活性，嵌入式系统大都设计有可编程逻辑器件CPLD。利用单片机对CPLD进行编程，可以方便地升级、修改和测试已完成的设计。文中给出了它的实现过程。
2024-02-21
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基于CPLD的卷积码编解码器的设计
卷积码是一种性能优良的差错控制编码。本文阐述了卷积码编解码器的基本工作原理，在MAX+PLUS2 软件平台上，给出了利用复杂可编程逻辑器件设计的（2，1，6）卷积码编解码器电路，并进行了编译和波形仿真
2024-05-08
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