Active HDL
共 1,809 篇文章
Active HDL 相关的电子技术资料，包括技术文档、应用笔记、电路设计、代码示例等，共 1809 篇文章，持续更新中。
cpld与8051的总线接口vhdl设计源码.rar
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->cpld与8051的总线接口vhdl设计源码.rar
abel-HDL Reference.pdf
资料->【C】嵌入系统->【C2】IC设计与FPGA->【0】综合（可编程逻辑器件、PAL、GAL、PLD、ASIC）->abel-HDL Reference.pdf
DSP集成电路设计
Digital signal processor is a new type of structure and high—performance microprocessors，
especially suitable for signal processing，communications，voice processing，image／graphics，
military,instrumen
VHDL_与数字电路设计.pdf
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL_与数字电路设计.pdf
Verilog HDL双向端口的使用
Verilog HDL双向端口的使用
Verilog HDL双向端口的使用
Verilog HDL双向端口的使用
基于SoC的红外图像数据通道设计
2005年全国单片机与嵌入式系统学术交流会论文，本文用三层结构的逻辑描述方式描述了红外数据通道的构架和设计，并给出了上述核心部分状态机的HDL（硬件描述语言）描述及其仿真结果。
FPGA详细教程__综合
PPT格式，一章内容
本章介绍了Xilinx公司的ISE5.2中的综合工具XST的综合属性、HDL代码参数设置、专用参数选项设置，使用XST综合设计、实行设计的步骤与方法。ISE5.2集成的下载配置工具iMPACT的结构、操作步骤与方法。Altera公司的QuartusII3.0编译器和编程器的使用步骤与方法。
Verilog HDL：A Guide to Digital Design and
·Verilog HDL：A Guide to Digital Design and
Active Balancing Solutions
linear 充电电池主动均衡方案简介.
主要用于电动汽车电池充电管理
单时钟CPU控制器
1. 实现能够执行R型、LW、SW、BEQ以及J指令的单时钟控制器，使其能够支持基本的指令。 2. 用Verilog HDL实现单时钟CPU控制器，在ISE上进行波形仿真，并在FPGA上实现
ACTIVE LED 方案
ACTIVE LED 方案，全系列LED照明
状态机设计
通过Verilog HDL语言设计状态机，实现简单状态机设计。
FPGA控制12864显示
本实验是通过FPGA设计LCD12864显示汉字。（LCD带字库）用Verilog HDL语言描述。
秒表
通过Verilog HDl语言设计数字秒表，设计灵活。
VHDL training.rar
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vhdl多媒体教程.rar
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->vhdl多媒体教程.rar
基于FPGA的多功能实验板的设计
设计和实现了一个以Altera FPGA的Cyclone器件EP1C6Q240C8为核心的多功能实验板.它分为核心板和扩展板, 用户可以结合QuartusII集成开发环境, 使用VHDL语言、Verilog HDL语言或原理图, 进行编辑、综合和仿真, 通过本实验开发板加载配置并进行设计验证.经过测试验证了实验板的可行性和稳定性, 能够满足教学和科研的需要.
HDL设计资料.rar
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基于DSP_Builder的星座映射与解映射器设计
· 摘要： 提出了一种基于中国地面数字电视广播传输标准的星座映射与解映射器的设计方法.使用DSP Builder的各种模块搭建系统,并利用Signal Compiler生成HDL工程.在完成对所生成工程的优化后,进行相关软硬件仿真验证.实现了32QAM、16QAM星座映射器与解映射器的设计、仿真,并在利用DSP Builder进行DSP系统开发方面进行了深入的探索.
VHDL编程与仿真.rar
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