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UART转I2C的Verilog HDL代码，由北京邮电大学《VerilogHDL设计与EDA技术基础》教师编写

2014-08-03 127 Active+HDL

24C01A的Verilog HDL仿真代码，用于I2C接口模块的测试，由北京邮电大学《VerilogHDL设计与EDA技术基础》教师编写

2016-03-03 66 Active+HDL

华为Verilog HDL 入门教程，下载后请解压。

2016-06-04 43 Active+HDL

verilog hdl 综合实用教程，一本非常实用易学易懂的书

2013-12-15 65 Active+HDL

Verilog HDL 串口发送程序，在ACTEL Fusion FPGA上实验成功，和大家一起分享！^_^

2016-07-17 37 Active+HDL

BCD编码的Verilog HDL程序，能够实现BCD编码与卷积码。

2014-02-18 171 Active+HDL

基于Verilog HDL实现的电子钟设计，支持时分秒实时显示与校准功能，采用状态机控制逻辑确保操作稳定可靠。内置跑表模块，支持清零、启动、暂停及继续计时，满足嵌入式系统开发需求。

2026-02-24 1 Active+HDL

从基础到实践，逐步解析如何用Verilog HDL实现ARM7内核的逻辑设计。适合对数字电路和处理器架构感兴趣的开发者，提供清晰的代码结构与设计思路。

2026-02-25 3 Active+HDL