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2014-01-24 58 60天学习

60秒秒表设计，可暂停和分段计数等，所有功能是利用verilog HDL来描述，最后下载到CPLD/FPGA才能运行。

2017-06-08 109 60天学习

Verilog模60计数器，quartusii开发环境下实现verilog程序，比较适合初学verilog语言学习的同学

2023-02-05 8 60天学习