VIP专区-嵌入式/单片机编程源码精选合集系列（94）资源包含以下内容：1. 本文介绍了嵌入式系统的概念, 分析了μC/OS 的内核结构, 并详细介绍了在具有ARM 体系结构的S3C44B0 微处理器 上进行μC/OS 操作系统的移植和应用程序及驱动程序的开发。.2. 本文介绍了嵌入式系统的概念, 分析了μC/OS 的内核结构, 并详细介绍了在具有ARM 体系结构的S3C44B0 微处理器 上进行μC/OS 操作系统的移植和应用程序及驱动程序的开发。.3. 介绍嵌入式开发适合初学者的学习及有一定工作经验的人作为参考手册.4. 通过C++和GLUT.5. ht芯片通过IO口读写I2C芯片的汇编源代码.6. 该文档为dsp c6000系列的原理图资料,对于嵌入式开发者很有使用价值..7. 12864液晶的驱动程序.8. 一个完整的ASM程序.9. 单相电子式液晶电能表源程序已经是成熟产品的程序。.10. 一个用C语言控制的读写7022.11. 51开发板的源程序.12. sofia-sip-1.12.4.13. CPLD EPM7256原理图PCB图.14. 嵌入式LINUX 的驱动程序。采用2410的开发板全部可以通用（如使用引脚不同只要重新改脚定义）.15. 著名EDA工具软件VCS得技术资料。pdf格式。.16. 非常好完的游戏.17. keil c中io的编程.18. keil c中BUZZ的运用.19. Lcd的编成.20. 射频卡读卡电路和程序,以及网络芯片8019的电路和程序,功能是实现一个射频卡读卡,读出数据传输到上位机.通过网络..21. 这是一个串口通信程序.22. 该源码实现了为现场人员创建拥有GUI的嵌入式数据库,现场人员通过获得数据可以进行薪水调查,数据包括职位,企业类型,年收入,阅历.23. * 一、功能: Timestamp驱动演示代码. * 二、该源码需要硬件开发板的支持,因为ISS对Timestamp定时器的模拟还不够精确 * 如果将该源码运行于ISS模式下,将得不到精确的结.24. rtl8019驱动程序及其main函数的源码.25. C++嵌入系统实例不是很全,总共7个分别是2,3,5,6,7,8,9.26. C++嵌入系统实例不是很全,总共7个分别是2,3,5,6,7,8,9.27. C++嵌入系统实例不是很全,总共7个分别是2,3,5,6,7,8,9.28. C++嵌入系统实例不是很全,总共7个分别是2,3,5,6,7,8,9.29. WINCE MFC COM sample. (from EVC高級編程及其應用開發).30. 三星ARM9的LCD驱动板原理图和PCB图.31. 我设计的CAN总线模块.32. 三星ARM9 S3C2410 核心板原理图与PCB图.33. 我用三星ARM9 S3C2410 做的掌上电脑 原理图与pcb图.34. 一个大公司的ARM9开发板原理图.35. cypress fx2 firmware代码示例.36. cypress ezusb driver 代码模板.37. 不错的X86汇编代码示例.38. 汇编代码示例.39. 非常好的汇编代码示例.40. 本人以前做的些东西.
上传时间： 2013-06-09
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上传时间： 2013-07-01
上传用户：eeworm
卷积码是广泛应用于卫星通信、无线通信等多种通信系统的信道编码方式。Viterbi算法是卷积码的最大似然译码算法，该算法译码性能好、速度快，并且硬件实现结构比较简单，是最佳的卷积码译码算法。随着可编程逻辑技术的不断发展，使用FPGA实现Viterbi译码器的设计方法逐渐成为主流。不同通信系统所选用的卷积码不同，因此设计可重配置的Viterbi译码器，使其能够满足多种通信系统的应用需求，具有很重要的现实意义。 本文设计了基于FPGA的高速Viterbi译码器。在对Viterbi译码算法深入研究的基础上，重点研究了Viterbi译码器核心组成模块的电路实现算法。本设计中分支度量计算模块采用只计算可能的分支度量值的方法，节省了资源；加比选模块使用全并行结构保证处理速度；幸存路径管理模块使用3指针偶算法的流水线结构，大大提高了译码速度。在Xilinx ISE8.2i环境下，用VHDL硬件描述语言编写程序，实现(2，1，7)卷积码的Viterbi译码器。在(2，1，7)卷积码译码器基础上，扩展了Viterbi译码器的通用性，使其能够对不同的卷积码译码。译码器根据不同的工作模式，可以对(2，1，7)、(2，1，9)、(3，1，7)和(3，1，9)四种广泛运用的卷积码译码，并且可以修改译码深度等改变译码器性能的参数。 本文用Simulink搭建编译码系统的通信链路，生成测试Viterbi译码器所需的软判决输入。使用ModelSim SE6.0对各种模式的译码器进行全面仿真验证，Xilinx ISE8.2i时序分析报告表明译码器布局布线后最高译码速度可达200MHz。在FPGA和DSP组成的硬件平台上进一步测试译码器，译码器运行稳定可靠。最后，使用Simulink产生的数据对本文设计的Viterbi译码器的译码性能进行了分析，仿真结果表明，在同等条件下，本文设计的Viterbi译码器与Simulink中的Viterbi译码器模块的译码性能相当。
上传时间： 2013-06-24
上传用户：myworkpost
MAX3238E/MAX3248E Maxim AutoShutdown Plus 10nA RS-232 30 10nA MAX3237E/MAX3238E/MAX3248E +3.0V +5.5V RS-232
上传时间： 2013-06-02
上传用户：ghostparker
北斗卫星导航系统空间信号接口控制文件 1 文件范畴 2 系统概述 2.1 空间星座 2.2 坐标系统 2.3 时间系统 3 B1 信号规范 3.1 信号结构和基本特性参数 3.1.1信号结构 3.1.2信号基本特性 3.2 射频信号特性 3.2.1载波频率 3.2.2卫星信号工作带宽及带外抑制 3.2.3杂散 3.2.4载波相位噪声 3.2.5用户接收信号电平 3.2.6信号相关性 3.3 B1 频点测距码
上传时间： 2013-04-24
上传用户：Alick
系统组成.......................................................................................................................................................... 31.1 库 ...................................................................................................................................................... 31.2 原理图输入 ...................................................................................................................................... 31.3 设计转换和修改管理 ....................................................................................................................... 31.4 物理设计与加工数据的生成 ........................................................................................................... 31.5 高速 PCB 规划设计环境.................................................................................................................. 32 Cadence 设计流程........................................................................................................................................... 33 启动项目管理器.............................................................................................................................................. 4第二章 Cadence 安装................................................................................................ 6第三章 CADENCE 库管理..................................................................................... 153.1 中兴EDA 库管理系统...................................................................................................................... 153.2 CADENCE 库结构............................................................................................................................ 173.2.1 原理图（Concept HDL）库结构：........................................................................................ 173.2.2 PCB 库结构：............................................................................................................................. 173.2.3 仿真库结构： ............................................................................................................................. 18第四章 公司的 PCB 设计规范............................................................................... 19第五章常用技巧和常见问题处理......................................................................... 19
上传时间： 2013-10-31
上传用户：ligi201200
特点： 精确度0.1%满刻度 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT类比输出功能 输入与输出绝缘耐压2仟伏特/1分钟(input/output/power) 宽范围交直流兩用電源設計 尺寸小,穩定性高
上传时间： 2014-12-23
上传用户：ydd3625
ADUM1201: 双通道数字隔离器（1/1通道方向性） ADuM120x 是采用ADI公司iCoupler® 技术的双通道数字隔离器。这些隔离器件将高速CMOS与单芯片变压器技术融为一体，具有优于光耦合器等替代器件的出色性能特征。 iCoupler器件不用LED和光电二极管，因而不存在一般与光耦合器相关的设计困难。简单的iCoupler 数字接口和稳定的性能特征，可消除光耦合器通常具有的电流传输比不确定、非线性传递函数以及温度和使用寿命影响等问题。这些iCoupler产品不需要外部驱动器和其它。 特性： 8引脚窄体SOIC封装，符合RoHS标准 低功耗工作 双向通信 3 V/5 V电平转换 工作温度最高可达125°C
上传时间： 2014-01-17
上传用户：hui626493
特点(FEATURES) 精确度0.1%满刻度 (Accuracy 0.1%F.S.) 可作各式数学演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A| (Math functioA+B/A-B/AxB/A/B/A&B(Hi&Lo)/|A|/etc.....) 16 BIT 类比输出功能(16 bit DAC isolating analog output function) 输入/输出1/输出2绝缘耐压2仟伏特/1分钟(Dielectric strength 2KVac/1min. (input/output1/output2/power)) 宽范围交直流两用电源设计(Wide input range for auxiliary power) 尺寸小,稳定性高(Dimension small and High stability)
上传时间： 2013-11-24
上传用户：541657925
Providing power for the Pentium® microprocessor family isnot a trivial task by any means. In an effort to simplify thistask we have developed a new switching regulator controlcircuit and a new linear regulator to address the needs ofthese processors. Considerable time has been spent developingan optimized decoupling network. Here are severalcircuits using the new LTC®1266 synchronous buck regulatorcontrol chip and the LT®1584 linear regulator toprovide power for Pentium processors and Pentium VREprocessors. The Pentium processor has a supply requirementof 3.3V ±5%. The Pentium VRE processor requires3.500V ±100mV.
上传时间： 2013-11-01
上传用户：名爵少年
