2-Bus算例

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基于srt-2算法,利用verilog实现16位定点无符号数除法器(除数、被除数均由16位整数和16位小数组成,商由32位整数和16位小数构成,余数由32位小数组成)

2016-05-27 99 2-Bus算例

利用堆栈方式编程,实现科学计算器的简单功能,附带解方程。内有操作说明文件。

2023-11-02 6 2-Bus算例