16位除法
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本程序是在一位全加器的基础上设计一个16位的加法器,用Verilog HDL语言描述.
2013-12-03
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介绍了利用VHDL实现八位除法,采用层次化设计,该除法器采用了VHDL的混合输入方式,将除法器分成若干个子模块后,对各个子模块分别设计,各自生成功能模块完成整体设计,实现了任意八位无符号数的除法。
介绍了利用VHDL实现八位除法,采用层次化设计,该除法器采用了VHDL的混合输入方式,将除法器分成若干个子模块后,对各个子模块分别设计,各自生成功能模块完成整体设计,实现了任意八位无符号数的除法。
2016-12-21
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在DOS下显示16位位图。（TC编译通过） 颜色与原位图的颜色不匹配
在DOS下显示16位位图。（TC编译通过） 颜色与原位图的颜色不匹配，这只是一个测试程序，但在图像下面有一个调色板，可以通过w,a,s,d键选择两个颜色进行对调。每选择一种颜色后通过Q键确认。
2014-12-07
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MSP430系列16位超低功耗单片机原理与应用MSP430系列16位超低功耗单片机原理与应用
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2013-12-10
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