0-500kHz
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Verilog module containing a synthesizable CRC function // * polynomial: (0 1 8) // * data width: 8
2016-09-26
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PL/0 语言的编译程序的一个部件
PL/0 语言的编译程序的一个部件，词法分析器。读入由PL/0语言编写的源代码，识别其中的关键字、标志符、数字，转换成程序可识别的中间符号并输出，包含词法错误检测
2014-01-10
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