VIP专区-PCB源码精选合集系列（12）资源包含以下内容：1. pcb的深层规范.2. 印制板设计规范.3. AD9破解补丁.4. 印制电路板设计技术指导.5. 小型化设计的实现与应用.6. PCBA工艺焊点标准.7. pcb注意问题.8. PCB工艺流程培训教材.9. AD9软件下载.10. PCB布线设计之超强功略.11. PCB四层板设计讲解.12. Protel99SE设计PCB.13. PCB四层板常规层压结构及设计阻抗.14. 原创看图快速学PADS Router高级应用之一（宏的使用）.15. Protel DXP经典指导教程.16. PADS2007学习教材.17. PADS导出元件位置图坐标的方法.18. Protel99SE设计与仿真.19. 神速-三天学会PADS PCB Layout.20. PCBM_LP_Viewer_V2009.21. High-speed Digital Design 中文版(高速数字设计).22. 各种接插件封装.23. Pads(Power_PCB)快捷键.24. 电路原理图与PCB设计基础.25. 纽扣电池封装.26. BGA焊球重置工艺.27. 华为 PCB的EMC设计指南.28. 华为PCB_Layout设计规范.29. pads2007基本错误~检修.30. BlazeRouter使用手册.31. TI封装技术.32. PCB设计中关于过孔的知识.33. 跟我学自制电路板.34. PCB设计须知.35. 用Proteus ISIS的怎样原理图仿真.36. 电子焊接综述.37. 什么是导热硅脂？.38. PowerPCB快捷命令.39. 高速PCB基础理论及内存仿真技术.40. 表面贴装工程AOI的介绍.
上传时间： 2013-07-06
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资源包含以下内容：1.无线电收音机及无线电路的设计与制作-铃木宪次.pdf2.晶体管电路设计与制作 单管、双管电路以及各种晶体管应用电路-黑田彻.pdf3.模拟技术应用技巧101例-稻叶保 .pdf4.测量电子电路设计 滤波器篇-远坂俊昭.pdf5.测量电子电路设计—模拟篇.pdf6.电子元器件应用技术 基于OP放大器与晶体管的放大电路设计-黑田彻.pdf7.电子元器件的选择与应用 电阻器与电容器的种类、结构及性能-三宅和司.pdf8.直流电动机实际应用技巧，图解实用电子技术丛书.pdf9.锁相环(PLL)电路设计与应用-远坂俊昭.pdf10.高低频电路设计与制作-铃木雅臣.pdf11.高速数字电路设计与安装技巧-久保寺忠.pdf12.高频电路设计与制作.pdf13.图解实用电子技术丛书19册
上传时间： 2013-04-15
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物联网综合测试解决方案（2篇） 射频微波元器件及国防航天技术（4篇） 汽车毫米波雷达系统设计（3篇） 高速数字与骨干网设计与验证（5篇） IC仿真设计与验证（5篇） 5G及下一代无线通信技术（7篇）
上传时间： 2013-06-23
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高速CMOS数字集成电路实用手册
上传时间： 2013-04-15
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标准数字电路 54-74HC全系列高速CMOS数据手册(中文)
上传时间： 2013-08-04
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专辑类-器件数据手册专辑-120册-2.15G 高速CMOS数字集成电路实用手册-365页-8.2M.pdf
上传时间： 2013-06-15
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专辑类-器件数据手册专辑-120册-2.15G 标准数字电路-54-74HC全系列高速CMOS数据手册-中文-.pdf
上传时间： 2013-06-12
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本论文设计了一种基于FPGA的高速FIR数字滤波器,滤波器实现低通滤波,截止频率为1MHz,通带波纹小于1 dB,阻带最大衰减为-40 dB,输入输出数据为8位二进制,采样频率为10MHz。 论文首先简要介绍了数字滤波器的基本原理和线性FIR数字滤波器的性质、结构,根据滤波器的性能要求选择窗函数、确定系数,在算法上为了满足数字滤波器的要求,对系数放大512倍并取整,并用Matlab对数字滤波器原理进行了证明。同时简述了EDA技术和FPGA设计流程。 其次,论文说明了FIR数字滤波器模块的划分,并用Verilog语言在Modelsim环境下进行了功能测试。对于数字滤波器系数中的-1,-2,4这些简单的系数乘法直接进行移位和取反,可以极大的节省资源和优化设计。而对普通系数乘法采用4-BANT(4bits-at-a-time)的并行算法,用加法累加快速实现了乘积的运算；另外,在本设计进行部分积累加时,采用舍取冗余位,主要是根据设计时已对系数进行了放大,而输出时又要将结果相应的缩小,所以在累加时,提前对部分积缩小,从而减少了运算量,从时间和资源上都得到了优化。 论文的最后分别用Modelsim和Quartus II进行了FIR数字滤波器的前仿真和后仿真,将仿真的结果和Matlab中原理验证时得到的理想值进行了比较,并对所产生的误差进行了分析。仿真结果表明：本16阶FIR数字滤波器设计能够实现截止频率为1MHz的低通滤波,并且工作频率可达150MHz以上。
上传时间： 2013-05-24
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本论文设计了一种基于FPGA的高速FIR数字滤波器,滤波器实现低通滤波,截止频率为1MHz,通带波纹小于1 dB,阻带最大衰减为-40 dB,输入输出数据为8位二进制,采样频率为10MHz。 论文首先简要介绍了数字滤波器的基本原理和线性FIR数字滤波器的性质、结构,根据滤波器的性能要求选择窗函数、确定系数,在算法上为了满足数字滤波器的要求,对系数放大512倍并取整,并用Matlab对数字滤波器原理进行了证明。同时简述了EDA技术和FPGA设计流程。 其次,论文说明了FIR数字滤波器模块的划分,并用Verilog语言在Modelsim环境下进行了功能测试。对于数字滤波器系数中的-1,-2,4这些简单的系数乘法直接进行移位和取反,可以极大的节省资源和优化设计。而对普通系数乘法采用4-BANT(4bits-at-a-time)的并行算法,用加法累加快速实现了乘积的运算；另外,在本设计进行部分积累加时,采用舍取冗余位,主要是根据设计时已对系数进行了放大,而输出时又要将结果相应的缩小,所以在累加时,提前对部分积缩小,从而减少了运算量,从时间和资源上都得到了优化。 论文的最后分别用Modelsim和Quartus II进行了FIR数字滤波器的前仿真和后仿真,将仿真的结果和Matlab中原理验证时得到的理想值进行了比较,并对所产生的误差进行了分析。仿真结果表明：本16阶FIR数字滤波器设计能够实现截止频率为1MHz的低通滤波,并且工作频率可达150MHz以上。
上传时间： 2013-07-15
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数字存储示波器（DSO）上世纪八十年代开始出现，由于当时它的带宽和分辨率较低，实时性较差，没有具备模拟示波器的某些特点，因此并没有受到人们的重视。随着数字电路、大规模集成电路及微处理器技术的发展，尤其是高速模/数（A/D）转换器及半导体存储器（RAM）的发展，数字存储示波器的采样速率和实时性能得到了很大的提高，在工程测量中，越来越多的工程师用DSO来替代模拟示波器。 本文介绍了一款双通道采样速率达1GHz，分辨率为8Bits，实时带宽为200MHz数字存储示波器的研制。通过对具体功能和技术指标的分析，提出了FPGA＋ARM架构的技术方案。然后，本文分模块详细叙述了整机系统中部分模块，包括前端高速A/D转换器和FPGA的硬件模块设计，数据处理模块软件的设计，以及DSO的GPIB扩展接口逻辑模块的设计。 本文在分析了传统DSO架构的基础上，提出了本系统的设计思想和实现方案。在高速A/D选择上，国家半导体公司2005年推出的双通道采样速率达500MHz高速A/D转换器芯片ADC08D500，利用其双边沿采样模式（DES）实现对单通道1GHz的采样速率，并且用Xilinx公司Spraten-3E系列FPGA作为数据缓冲单元和存储单元，提高了系统的集成度和稳定性。其中，FPGA缓冲单元完成对不同时基情况下多通道数据的抽取，处理单元完成对数据正弦内插的计算，而DSO中其余数据处理功能包括数字滤波和FFT设计在后端的ARM内完成。DSO中常用的GPIB接口放在FPGA内集成，不仅充分利用了FPGA内丰富的逻辑资源，而且降低了整机成本，也减少了电路规模。 最后，利用ChipscopePro工具对采样系统进行调试，并分析了数据中的坏数据产生的原因，提出了解决方案, 并给出了FPGA接收高速A/D的正确数据。
上传时间： 2013-07-07
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