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用于高速AD的低抖动时钟稳定电路
介绍了一种用于高速ADC 的低抖动时钟稳定电路。这个电路由延迟锁相环(DLL)来实现。这个DLL 有两个功能：一是通过把一个时钟沿固定精确延迟半个周期，再与另一个沿组成一个新的时钟来调节时钟占
2023-10-25
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高速Viterbi译码器的FPGA实现.rar
本文提出了一种高速Viterbi译码器的FPGA实现方案。这种Viterbi译码器的设计方案既可以制成高性能的单片差错控制器，也可以集成到大规模ASIC通信芯片中，作为全数字接收的一部分。 本文所设计的Viterbi译码器采用了基四算法，与...
2023-10-04
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高速PCI密码卡设计与实现
· 摘要： 给出了一种基于PCI总线的高速密码卡设计方案,并对其各模块进行了分析,该方案采用DSP+CPLD+密码模块的结构,完全实现了在系统编程和配置,主机通过PCI9054直接操作密码模块,实现了高速的数据加脱密....
2024-08-23
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