Turbo码编码器的删除模块，此模块是CCSDS标准系的码率为1/2和1/3的删除模块
上传时间： 2013-12-11
上传用户：plsee
随着 国 内 遥感卫星的迅 速发展卫星 图 像的 图 幅越来 越大分辨率越来越高 。 在轨 遥感 图 像的几何 精 度 评价要求从待评遥感 图 像和 多源 参考 图 像之间精确 地提取出 分布 均 匀 的控 制 点 信 息 。 使用 滤波 对高 分辨率影像进 行增强时 ， 会 产生过增强 和饱和 现象 影响 了 控制 点 提取效果。 为 了 克 服上述缺陷 提出 了 一 种基于 稀 疏识別的 自 适应 图像增 强算 法。 方法 首先计算 图像子区域的 辐射质量参数并构 建 分类特征 ； 然 后通过 稀疏识别算 法确 定子区域的 地物 类型； 最后根据子区域所属 地物类 型 ， 选择不同 的 滤 波 参数 实 现整幅图 像 的 自 适 应增 强 并 在增 强 的 遥感图 像上提 取控制 点 信息 实 现遥感图像 的 几何精 度 自 动 化评价。 结果 针 对资源 三号卫星影 像的 实 验结果表明 针对不同 的 子区域地物 类型进行 自 适 应 增强， 有 效 防 止了 基于全局统一 参 数的 滤波带来 的 过增 强和饱和现象 有 效增强 了 高 分辨 率图像 的纹理。 结论 提出 了 一 种 新的高分 辨率遥 感影像增强 策略 增强了 高 分辨率图 像的 纹理， 提高 了控制 点的 获 取数 目 和 准 确 率。 关键词： 稀疏识别 ； 辐射参数 ； 自 适应 增强； 提取控制 点
上传时间： 2015-11-22
上传用户：chao1020
[摘要]在天线单元设计中采用了高频、低噪声放大器，以减弱天线热噪声及前面几级单元电路对接收机性能的影响；基于超外差式电路结构、镜频抑制和信道选择原理，选用G P2010芯片实现了射频单元的三级变频方案，并介绍了高稳定度本振荡信号的合成和采样量化器的工作原理，得到了导航电文相关提取所需要的二进制数字中频卫星信号。[被屏蔽广告]关键词：GPS接收机灵敏度超外差锁相环频率合成利用GPS卫星实现导航定位时，用户接收机的主要任务是提取卫星信号中的伪随机噪声码和数据码，以进一步解算得到接收机载体的位置、速度和时间（PVT）等导航信息。因此，GPS接收机是至关重要的用户设备。目前实际应用的GPS接收机电路一般由天线单元、射频单元、通信单元和解算单元等四部分组成，如图1所示。本文在分析GPS卫星信号组成的基础上，给出了射频前端GP2010的原理及应用。1GPS 卫星信号的组成GPS卫星信号采用典型的码分多址（CDMA）调制技术进行合成（如图2所示），其完整信号主要包括载波、伪随机码和数据码等三种分量。信号载波处于L波段，两载波的中心顿率分别记作L1和1.2，卫星信号参考时钟频率f0为10.23MHz，信号载波L1的中心频率为ro的154倍频，即：fL.1=154×f0-1575，42MHz（1）其波长A 1-19.03cm：信号载波12的中心频率为f0的120倍频，即：fL.2-120X f0-1227.60M1z（2）其波长A 2-24.42cm.两载波的频率差为347.82M1z，大约是12的28.3%，这样选择载波频率便于测得或消除导航信号从GPS卫星传播至接收机时由于电离层效应而引起的传播延迟误差，伪随机噪声码（PR N）即测距码主要有精测距码（P码）和粗测距码（C/A码）两种。其中P码的码率为10.23M12、C/A码的码率为1.023MHz。数据码是GPS卫星以二进制形式发送给用户接收机的导航定位数据，又叫导航电文或D码，它主要包括卫星历、卫星钟校正、电离层延迟校正、工作状态信息、C/A码转换到捕获P码的信息和全部卫星的概略星历：总电文由1500位组成，分为5个子帧，每个子帧在6s内发射10个字，每个字30位，共计300位，因此数据码的波特率为50bps.
上传时间： 2022-06-19
上传用户：zhaiyawei
本课题给出了一种基于高速PCI总线、以FPGA为核心处理器和控制器的高分辨率实时图像处理系统，该系统可实现对高分辨率高帧率图像（1024*768@60HZ）的实时采集、处理以及输出。本文首先给出了高分辨率实时图像处理系统的系统方案，然后介绍了高分辨率实时图像处理卡的详细设计方案。本文的重点在于介绍高分辨率实时图像处理系统的FPGA控制逻辑设计，主要研究了该数字图像处理系统中影响系统实时处理速度的数据流控制技术，如PCI接口控制、FPGA与外部RAM的高速读写控制、图像的采集预处理，图像的输出控制等，本文还介绍了高分辨率实时图像处理卡的上位机应用程序设计与实现，本文的最后介绍了系统的调试及应用。验证结果表明，本文所设计的接口模块可以很好地应用在高分辨率实时图像处理系统中，采用这些接口模块，系统能有效完成上述的图像数据流控制功能。
上传时间： 2022-07-27
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随着数码技术的不断发展，数字图像处理的应用领域不断扩大，其实时处理技术成为研究的热点。VLSI技术的迅猛发展为数字图像实时处理技术提供了硬件基础。其中FPGA(现场可编程门阵列)的特点使其非常适用于进行一些基于像素级的图像处理。 传统的图像显示系统必须连接到PC才能观察图像视频，存在着高速实时性、稳定性问题。本设计脱离高清晰工业相机必须与PC连接才可以观看到高清晰图像的束缚，实现系统的小型化。针对130万像素彩色1/2英寸镁光CMOS图像传感器，提出用硬件实现Bayer格式到RGB格式转换的设计方案，完成由黑白图像到高清彩色图像的转换，用SDRAM作缓存，输出标准VGA信号，可直接连接VGA显示器、投影仪等设备进行实时的视频图像观看，与模拟相机740X576分辨率(480线)图像相比，设计图像画质相当于1280X1024分辨率(750线)，最高帧率25fps，整个结构应用FPGA作为主控制器，用少量的缓存代替传统的大容量存储，加快了运算速率，减小了电路规模，满足图像实时处理的要求，使展现出来的视频图像得到质的飞跃。可以广泛应用于工业控制和远程监控等领域。 论文研究的重点是采用altera公司EP2C芯片前端驱动CMOS图像传感器，实时采集Bayer图像象素，分析研究CFA图像插值算法，实现了基于FPGA的实时线性插值算法，能够对输入是每像素8bit、分辨率为1280×1204的Bayer模式图像数据进行实时重构，输出彩色RGB图像。由端口FIFO作为数据缓冲，存储一帧图像到高速SDRAM，构建VGA显示控制器，实现对输入是每像素24bit(RGB101010)、分辨率为640×480、帧频25HZ彩色图像进行实时显示。 整个模块结构包括电源模块单元等、CMOS成像单元、FPGA数据处理单元、SDRAM控制单元、VGA显示接口单元。 最后，对系统进行了调试。经实验验证，系统达到了实时性，能正确和可靠的工作。整个设计模块能够满足高帧率和高清晰的实时图像处理，占用系统资源很少，用较少的时间完成了图像数据的转换，提高了效率。
上传时间： 2013-06-08
上传用户：zhengjian
随着通信产业的发展，尤其是今年3G牌照的发放，视频业务在移动多媒体方面将会有更加重要的地位，所以在移动终端上实现支持高效视频编码标准的解码功能就成为一项非常有实际意义的工作。 H．264作为新一代的高压缩率的视频标准，凭借其较高的压缩率和优秀图像质量，使得H．264只要利用较小的空间就能存储更多的视频数据，在更低的网络带宽条件下提供更优质量的视频。然而高度的压缩必然付出较高的硬件代价。如何能完成视频良好解码并能节约硬件资源成为研究热点。 考虑到H．264视频编解码的计算复杂度，在硬件选择上一般比较注重高性能处理器的选择。计算目前主流的实现方式包括ASIC的专用集成芯片实现或者是DSP的软件实现。ARM处理器伴随技术的进步，尤其是对支持数字信号处理的功能加强后，在视频编解码领域的应用也越来越广泛。 本文以WindowsCE5．0和S3C2440A嵌入式平台作为H．264解码器的载体，研究的代码版本是t264-src-0．14，主要进行了以下几个方面的工作： 研究了H．264视频压缩标准和它的体系结构，尤其是对解码器部分进行了硬件要求的分析。 深入研究了WINCE5．0和ARM结合的平台特性，根据实际的硬件平台需要，定制了相应的操作系统。 完成了基于T264代码的解码库在WINCE5．0下的移植，并进行了相应的代码和算法的优化并完成了基于WINCE5．0操作系统下播放程序的编写。 通过实验数据证明，在基于单核的ARM芯片中，主要靠软件进行QCIF格式的H．264视频解码从而获得良好播放效果的方法是有效的。
上传时间： 2013-07-24
上传用户：myworkpost
本文从总体方案、硬件电路、软件程序、性能测试等几个方面详细地阐述了基于FPGA与USB2.0的数据采集系统。采集系统选用高采样率低噪声的12位AD转换芯片进行AD转换电路设计；借助频率高、内部时延小的FPGA芯片实现USB固件并以此控制USB接口芯片，通过乒乓的方式对采样数据进行缓存，提高了系统数据吞吐能力；运用USB2.0标准的接口芯片为整个采集系统提供USB的通信能力。采用集成度较高的FPGA芯片作为系统控制核心，降低了设计难度，提高了系统稳定性，同时还减小了设备体积。
上传时间： 2013-04-24
上传用户：xuanjie
ISO和ITU-T制定的一系列视频编码国际标准的推出，开创了视频通信和存储应用的新纪元。从H.261视频编码建议，到H.262/3、MPEG-1/2/4等都有一个共同的不断追求的目标，即在尽可能低的码率(或存储容量)下获得尽可能好的图像质量。 本课题的研究建立在目前主流的压缩算法的基础上，综合出各种标准中实现途径的共性和优势，将算法的主体移植于FPGA(FieldProgrammableGateArray)平台上。凭借该种类嵌入式系统配置灵活、资源丰富的特点，建立一个可重构的内核处理模块。进一步的完善算法(运算速度、精度)和外围系统后，就可作为专用视频压缩编码器进行门级电路设计的原型，构建一个片上可编程的独立系统。 编码器设计有良好的应用前景，通过使用离散余弦变换和熵编码，对运动图像从空间上进行压缩编码，使得编码后的数据流适合于传输、通信、存储和编辑等方面的要求。同时，系统的设计将解码的工作量大幅度降低，功能模块在作适当的改动后可为解码器的参考设计使用。 研究所涉及的各功能模块都进行了系统性的仿真和综合，满足工程样机的前期研发需要。
上传时间： 2013-04-24
上传用户：xiangwuy
随着多媒体技术发展，数字图像处理已经成为众多应用系统的核心和基础。图像处理作为一种重要的现代技术，已经广泛应用于军事指挥、大视场展览、跟踪雷达、电视会议、导航等众多领域。因而，实现高分辨率高帧率图像实时处理的技术不仅具有广泛的应用前景，而且对相关领域的发展也具有深远意义。 大视场可视化系统由于屏幕尺寸很大，只有在特制的曲面屏幕上才能使细节得到充分地展现。为了在曲面屏幕上正确的显示图像，需要在投影前实时地对图像进行几何校正和边缘融合。而现场可编程门阵列(FPGA)则是用硬件处理实时图像数据的理想选择，基于FPGA的图像处理技术是世界范围内广泛关注的研究领域。 本课题的主要工作就是设计一个以FPGA为核心的硬件系统，该系统可对高分辨率高刷新率(1024*768@60Hz)的视频图像实时地进行几何校正和边缘融合。 论文首先介绍了图像处理的几何原理，然后提出了基于FPGA的大视场实时图像融合处理系统的设计方案和模块功能划分。系统分为算法与软件设计，硬件电路设计和FPGA逻辑设计三个大的部分。本论文主要负责FPGA的逻辑设计。围绕FPGA的逻辑设计，论文先介绍了系统涉及的关键技术，以及使用Verilog语言进行逻辑设计的基本原则。 论文重点对FPGA内部模块设计进行了详细的阐述。仲裁与控制模块是顶模块的主体部分，主要实现系统状态机和时序控制；参数表模块主要实现SDRAM存储器的控制器接口，用于图像处理时读取参数信息。图像处理模块是整个系统的核心，通过调用FPGA内嵌的XtremeDSP模块，高速地完成对图像数据的乘累加运算。最后论文提出并实现了一种基于PicoBlaze核的12C总线接口用于配置FPGA外围芯片。 经过对寄存器传输级VerilogHDL代码的综合和仿真，结果表明，本文所设计的系统可以应用在大视场可视化系统中完成对高分辨率高帧率图像的实时处理。
上传时间： 2013-05-19
上传用户：恋天使569
DAC3484 和DAC34H84 是德州仪器（Texas Instruments）新推出的低功耗，高密度，高采样率，高性能的数模转换芯片，这款芯片目前已经广泛的应用在通信行业。本文详细介绍了DAC3484，DAC34H84 与正交调制器的输出接口以及输出功率定标的计算问题。
上传时间： 2013-10-18
上传用户：sun_pro12580
