卷积编码是深空通信系统和无线通信系统中常用的一种编码方式。Viterbi码算法是卷积码的一种最大似然译码算法，它按照最大似然译码准则，在网格图上找出一条最大似然路径来得到译码结果。本设计的主要内容是3比特软判决Viterbi译码器的FPGA实现，设计是采用硬件VHDL语言来完成，并在ModelSim和Quartus Ⅱ软件环境下进行编译和仿真。在论文中介绍了Viterbi译码器的各模块的各种算法，并着重介绍了本设计所采用的具体方法，通过仿真和测试，验证了设计的正确性。最后，介绍了Viterbi译码器在未来通信中的发展和应用。
上传时间： 2013-07-02
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本文对于全并行Viterbi译码器的设计及其FPGA实现方案进行了研究，并最终将用FPGA实现的译码器嵌入到某数字通信系统之中。 首先介绍了卷积码及Viterbi译码算法的基本原理，并对卷积码的纠错性能进行了理论分析。接着介绍了Viterbi译码器各个模块实现的一些经典算法，对这些算法的硬件结构设计进行优化并利用FPGA实现，而后在QuartusⅡ平台上对各模块的实现进行仿真以及在Matlab平台上对结果进行验证。最后给出Viterbi译码模块应用在实际系统上的误码率测试性能结果。 测试结果表明，系统的误码率达到了工程标准的要求，从而验证了译码器设计的可靠性，同时所设计的基于FPGA实现的全并行Viterbi译码器适用于高速数据传输的应用场合。
上传时间： 2013-07-30
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数字式π/4-DQPSK是一种线性窄带调制技术，具有频谱利用率高、频谱特性好、抗衰落性能强、可用非相干解调等突出特点。在移动通信、卫星通信中得到广泛应用。 本文介绍了π/4-DQPSK调制解调的基本原理和各个模块的设计实现；完成了调制解调算法的Matlab仿真设计；采用VHDL硬件描述语言在Xilinx公司的ISE5.2开发环境下设计实现各个模块，通过了时序仿真，实现了正确解调；分析了在实现过程中，采用1bit差分检测了误码率。文章由推出的误码率表达式得到静态高斯噪声下，信噪比为16dB时误码率可达10-8。用Protel99SE进行PCB板设计，完成程序下载进FPGA芯片以及电路调试，其输入符号速率200kbps，调制中频455kHz。测试结果验证了程序的正确，实现了π/4-DQPSK调制解调系统完成预定的目标。
上传时间： 2013-04-24
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本文主要阐述基于FPGA对IEEE802.3快速以太网MAC层功能的实现.首先介绍了以太网协议以及快速以太网接入无源光网EPON的原理,然后重点阐述了MAC层的FPGA设计、仿真及测试.先总体介绍了对整个MAC系统的内部结构、模块划分,再对各个模块的设计进行了详细的描述,接着介绍了开发环境和验证工具,之后给出了测试方案,验证数据、实现结果及时序仿真波形图.最后是对下一步将设计的MAC IP应用于EPON的MAC层协议进行了研究分析,通过数学推导和实例给出了MPCP的DBA算法,并讨论了在MAC核中添加MPCP协议的实现方法.
上传时间： 2013-06-10
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本文着重研究了多路数字节目复用器中的对多路预处理TS流复用的原理和基于FPGA的实现方法。首先论述了关于数字电视系统的一些基本概念，介绍了MPEG-2/DVB标准以及数字电视节目专用信息(PSI)，并结合多路数字节目复用的基本原理提出了一套基于FPGA的设计方案。通过对复用器输入部分、复用控制逻辑和PCR校正等一系列模块的设计及仿真验证，达到了设计的要求，取得了一定的研究成果。
上传时间： 2013-06-09
上传用户：bugtamor
本文提出了一种适合于嵌入式SoC的USB器件端处理器的硬件实现结构。并主要研究了USB器件端处理器的RTL级实现及FPGA原型验证、和ASIC实现研究，包括从模型建立、算法仿真、各个模块的RTL级设计及仿真、FPGA的下载测试和ASIC的综合分析。它的速度满足预定的48MHz，等效门面积不超过1万门，完全可应用于SOC设计中。 本文重点对嵌入式USB器件端处理器的FPGA实现作了研究。为了准确测试本处理器的运行情况，本文应用串口传递测试数据入FPGA开发板，测试模块读入测试数据，发送入PC机的主机端。通过NI-VISA充当软件端，检验测试数据的正确。
上传时间： 2013-07-24
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本文设计实现了一种基于FPGA的DES加密系统。 概括起来，本文主要完成了以下几方面的主要工作：完成了DES加密系统的整体设计。整个系统包括DES加密核心模块，UART通信接口模块和BLOCKRAM存储模块。以EITS2003开发板为硬件开发平台，ISEwebpack为开发软件，用Verilog硬件描述语言设计并且实现了三大模块的具体功能及整体连接。用PC，串口调试工具，UART通信接口和EITS2003开发板测试并验证了整个系统的功能。探讨了DES加密系统在军事通信总站内的应用。
上传时间： 2013-06-14
上传用户：dancnc
本文提出一种基于PC104嵌入式工业控制计算机与现场可编程门阵列(FPGA)的PCB测试机的硬件控制系统设计方案。方案中设计高效高压控制电路，实现测试电压与测试电流的精确数字控制。选用双高压电子开关形式代替高压模拟电子开关，大幅度提高测试电压。采用多电源方式在低控制电压下实现对高压电子开关的控制。设计高速信号处理电路对测试信号进行处理，从硬件上提高系统测试速度。 本设计中选用Altera公司的现场可编程器(FPGA)EP1K50，利用EDA设计工具Synplify、Modelsim、QuartusⅡ以及Verilog硬件描述语言完成了控制系统的硬件设计及调试，解决了由常规电路难以实现的问题。
上传时间： 2013-06-04
上传用户：lizhen9880
作者研究了当前流行的缩放算法，对图像纹理相关性大小和边缘方向的判断上提出了一种新的方法，并在此基础上发展了一套适用于数字视频芯片的图像缩放算法。仿真结果表明此算法由优于目前流行的图像缩放算法。 介绍了FPGA的开发工作大致可以分为设计和验证两大部分，在具体开发流程上可以根据要求灵活控制。缩放芯片的开发可以分为：芯片结构设计、时钟系统设计、存储器读写控制、IP核复用设计、计算精度控制等方面的电路设计。在设计完成各级子模块以后拼接各子模快完成整个缩放模块的设计。通过测试发现设计中存在的缺陷，修改再测试，最终完成整个模块的设计。
上传时间： 2013-05-31
上传用户：tdyoung
论文首先介绍了SRAM型FPGA的典型代表XC4000系列的结构和主要特性，并对XC4000系列器件的配置模式和配置顺序做了简单介绍。根据XC4000系列器件各组成模块的功能和特点，可以将其分为可编程逻辑功能块(CLB)、输入输出功能块(IOB)、互连资源(IR)、可配置接口模块(CIM)和进位逻辑(CLM)等五大部分组成。 对于这五个功能模块，可以采用“分治法”分别考虑各个模块的测试问题。论文随后深入讨论了各模块的测试问题，由于RAM测试的特殊性，所以对函数发生器RAM模式的测试单独进行了讨论。
上传时间： 2013-06-29
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