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FIFO的verilog代码...

📅 2013-11-22 👤 不懂夜的黑

verilog FIFO 代码

  　　赛灵思推出业界首款自动化精细粒度时钟门控解决方案，该解决方案可将 Virtex®-6 和 Spartan®-6 FPGA 设计方案的动态功耗降低高达 30%。赛灵思智能时钟门控优化可自动应用于整个设计，既无需在设计流程中添加更多新的工具或步骤，又不会改变现有...

📅 2013-11-16 👤 eastimage

370 WP 智能时钟动态

ZBT SRAM控制器参考设计,xilinx提供VHDL代码 Description:   Contains the following files     readme.txt appnote_zbtp.vhd appnote_zbtf.vhd ...

📅 2013-11-24 👤 31633073

xilinx SRAM VHDL ZBT

USB接口控制器参考设计,xilinx提供VHDL代码 usb xilinx vhdl ;  This program is free software; you can redistribute it and/or modify ;  it under the ter...

📅 2013-10-12 👤 windgate

xilinx VHDL USB us

ref-sdr-sdram-vhdl代码 SDR SDRAM Controller v1.1 readme.txt This readme file for the SDR SDRAM Controller includes information that was not incor...

📅 2013-11-13 👤 takako_yang

sdram vhdl ref sdr

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