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频编解码

  • 请用CAJViewer打开.本文在分析研究G729算法原理的基础上

    请用CAJViewer打开.本文在分析研究G729算法原理的基础上,提出了有效实现G729标准 的硬件设计和几种软件优化方法。本文在对语音编解码的相关理论学习和掌 握后对G729标准进行了细致地研究和深入地理解 根据G729实现中对存 储空间和处理器运算速度等各项性能指标的要求,选择合适芯片,设计了实现 G729编解码器的硬件平台 通过对G729标准的详细分析和研究,分别提出 了C语言级、编译器级和算法级的有效优化方法,通过在DSP上实现及仿真, 并且根据主观评价和客观计算结果验证该算法的可行性。

    标签: CAJViewer G729 算法原理

    上传时间: 2014-01-10

    上传用户:kernaling

  • 这是上海交通大学著名数字电视专家

    这是上海交通大学著名数字电视专家,第一批长江学者特聘教授张文军的关于数字电视的PPT。该PPT很专业,学术水平很高,制作很精美。涵盖了包括模拟电视,数字电视,各种音视频编解码方案,数字电视在我国的发展概括等内容,是从事音视频信号处理人月不可多得的好资料。

    标签: 大学 数字电视

    上传时间: 2016-03-09

    上传用户:moerwang

  • 基于PCM和CVSD技术的语音编码仿真:在VC6.0环境下

    基于PCM和CVSD技术的语音编码仿真:在VC6.0环境下,编写动态链接库DLL程序,向上层应用程序(东大语音传输实验软件)提供函数接口和消息。这些函数接口即PCM与CVSD编解码的实现。

    标签: CVSD PCM 6.0 VC

    上传时间: 2016-03-10

    上传用户:许小华

  • 离散余玄的数学实现

    离散余玄的数学实现,做音视频编解码的朋友深造必备哦.

    标签: 离散

    上传时间: 2016-03-26

    上传用户:xz85592677

  • speex-1.2beta3源代码

    speex-1.2beta3源代码,音频编解码,带回声消除

    标签: speex beta 1.2 源代码

    上传时间: 2013-12-20

    上传用户:dapangxie

  • 基于FPGA/CPLD

    基于FPGA/CPLD,采用VHDL语言的曼彻斯特的编解码实现。还包含曼彻斯特码的说明文档。

    标签: FPGA CPLD

    上传时间: 2013-12-30

    上传用户:515414293

  • linux嵌入式开发程序

    linux嵌入式开发程序,基于富士通frv系统,主要是视频音频处理,其中包括mp4应用程序,mpeg编解码,mp3编解码

    标签: linux 嵌入式开发 程序

    上传时间: 2016-04-29

    上传用户:水口鸿胜电器

  • [T264_decoder.rar] - 经过开源的H.264压缩算法代码

    [T264_decoder.rar] - 经过开源的H.264压缩算法代码,进行优化后并在VC++6。0环境下调试和PC下成功运行,也可以在DSP上运行 [x264-windows.rar] - X264,H.264编码器源代码,在windows下用VC编译通过, [技术手册arm.rar] - arm技术手册,详细讲解了利用arm开发嵌入式系统的各个流程以及详细的步骤,对于初学arm的开发人员来说是不可多得的好手册! [2005827161349.rar] - 介绍嵌入式的视频,来自上海交通大学,是一个ARM培训的视频教程 [H.264_CODEC_Src.zip] - 标准H.264编解码源代码,C语言实现,值得参考。 [h264new.rar] - 最新视频传输协议H.264的c语言源代码

    标签: 264 decoder 开源

    上传时间: 2013-12-30

    上传用户:xiaoyunyun

  • ListCodecProps 这是一个基于对话框的MFC程序

    ListCodecProps 这是一个基于对话框的MFC程序,枚举系统中所有的Windows Media编解码器,并查看每个 编解码器的属性,如视频复杂度级别、是否支持VBR、支持的格式

    标签: ListCodecProps MFC 对话框 程序

    上传时间: 2016-05-04

    上传用户:zhaiyanzhong

  • vhdl编写

    vhdl编写,8b—10b 编解码器设计 Encoder: 8b/10b Encoder (file: 8b10b_enc.vhd) Synchronous clocked inputs (latched on each clock rising edge) 8-bit parallel unencoded data input KI input selects data or control encoding Asynchronous active high reset initializes all logic Encoded data output 10-bit parallel encoded output valid 1 clock later Decoder: 8b/10b Decoder (file: 8b10b_dec.vhd) Synchronous clocked inputs (latched on each clock rising edge) 10-bit parallel encoded data input Asynchronous active high reset initializes all logic Decoded data, disparity and KO outputs 8-bit parallel unencoded output valid 1 clock later

    标签: vhdl 编写

    上传时间: 2016-05-05

    上传用户:gundamwzc