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查看全部 500 份 →基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。
基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。
2014-08-07
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日历时钟 按 进入设置状态 按 停止闹钟声音 按 依次进入闹钟功能是否启用
日历时钟 按 进入设置状态 按 停止闹钟声音 按 依次进入闹钟功能是否启用，闹钟时 分秒 年月 日及时间时 分 秒的设置 直到退出设置状态 按 调整是否起用闹钟和调节闹钟时 分 秒年 月 日 时间的时分 秒的数字 第 （可在调整状态进行设置...
2017-07-10
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