基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。 - 免费下载

VHDL/FPGA/Verilog资源文件大小：3 K

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所属分类

VHDL/FPGA/Verilog

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2014-08-07 20:30

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资源简介

基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。

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1 📃

闹钟程序.txt

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