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基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。

VHDL/FPGA/Verilog 3 K 111 次下载 2014-08-07

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RAR

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3 K

资源分类

VHDL/FPGA/Verilog

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2014-08-07 20:30

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基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。 - 资源详细说明

基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。

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