锁相环路
锁相环路简称锁相环(PLL)，是一种输出一定频率信号的振电路，也称为相位同步环(回路)。该回路利用外部施加的基准信号与PLL回路内的振荡器输出的相位差恒定的反馈控制来产生振荡信号。电子设备在正常工作时,通常需要外部的输入信号与内部的振荡信号同步，利用锁相环路就可以实现这个目的。[1]
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2023-05-19
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基于TMS320LF2407A的软件锁相环的设计与实现
· 摘要： 按照锁相环的原理,研究了一种利用DSP TMS320LF2407A实现的软件锁相环用于风力发电并网逆变器,以产生与电网同频、同相的交流电,使并网逆变器的功率因数接近于1,减少对电网的污染.就本种软件锁相环实...
2023-06-03
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FPGA内嵌200MHz低噪声锁相环时钟发生器
FPGA器件在通信、消费类电子等领域应用越来越广泛，随着FPGA规模的增大、功能的加强对时钟的要求也越来越高。在FPGA中嵌入时钟发生器对解决该问题是一个不错的选择。本论文首先，描述并分析了电荷泵锁相环时钟发生器的体系结构、组成单元及各单元...
2024-01-11
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FPGA片内延时锁相环架构研究与设计
FPGA(现场可编程门阵列)芯片是IC领域的重要组成部分，越来越多的集成电路设计和仿真依靠其来完成。目前市场上的FPGA芯片以欧美大公司的产品占主导，国内的可编程逻辑芯片设计和制造尚处于起步阶段，因此这一方向的研究...
2024-05-11
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