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在软件接收机的基础上,利用鉴频器辅助鉴相器的输出,引入一个模糊逻辑控制器,使得环路能够智能跟踪信号的动态变化.实验结果证明所提出的设计方法与传统环路相比可大幅度缩短跟踪时间,减小环路滤波器带宽,并能消...

📅 2016-09-01

针对混频器在接收机电路中的重要性，设计实现了一种基于F1596的乘积型混频器电路。为使该电路能够输出频率稳定的信号，在电路设计中采用鉴频器取样控制VCO产生的本振信号，使该电路具有频谱纯净、失真度小、...

📅 2014-01-18

DPLL由鉴相器模K加减计数器脉冲加减电路同步建立侦察电路模N分频器构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K...

📅 2013-12-26

编码器信号处理经过倍频器进行四倍频后同时完成鉴相计数...

📅 2014-01-22

计数器,分频器,锁存器,驱动器分册...

📅 2013-04-15

专辑类-器件数据手册专辑-120册-2.15G 现代集成电路实用手册-计数器-分频器-锁存器-驱动器分册-338页-5.7M.pdf...

📅 2013-04-24

基于FPGA的分频器,可以根据更改参数,实现不同倍数的分频....

📅 2013-08-15

fredivn.vhd 偶数分频\r\nfredivn1.vhd 奇数分频\r\nfrediv16.vhd 16分频\r\nPULSE.vhd 数控分频器...

📅 2013-08-15

verilog编写基于fpga的鉴相器模块...

📅 2013-08-19

用Verilog实现基于FPGA的通用分频器...

📅 2013-08-30

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