在现代电子系统中，数字化已经成为发展的必然趋势，接收机数字化是电子系统数字化中的一项重要内容，对数字化接收机的研究具有重要的意义。随着数字化理论和微电子技术的迅速发展，高速的中频数字化接收机的实现已经成为可能。本文研究了一种基于FPGA的软件无线电数字接收平台的设计，并着重研究了其中数字中频处理单元的设计和实现。FPGA器件具有设计灵活、开发周期短和开发成本低等优点，所以广泛应用于各种通信系统中。相比于传统的DSP串行结构，FPGA能够进行流水线性设计，对数据进行并行处理，所以FPGA在进行数据量大，要求实时处理的系统设计时有很大的优势。 本文首先首先分析了软件无线电当前的发展趋势及技术现状，针对存在的处理速度跟不上的DSP瓶颈问题，提出了中频软件无线电的FPGA实现方案。本文以FPGA实现为重点，在深入分析软件无线电相关理论的基础上，着重研究和完成了中频软件无线电数字接收平台两大模块的FPGA实现：数字下变频相关模块和数字调制解调模块。其中，在深入研究数字下变频实现结构的基础上，首先对数字下变频模块的数控振荡器(NCO)采用了直接频率合成技术(DDS)实现，其频率分辨率高，灵活，易于实现；高效抽取滤波器组由积分梳状滤波器(CIC)，半带滤波器(HB)，FIR滤波器组成。对积分梳状滤波器(CIC)本文采用了Hogenaur“剪除”理论对内部寄存器的位宽进行改进，极大地节约了资源，提高了运行速率。对FIR滤波器和半带滤波器采用了(DA)分布式算法，它的运行速度只与数据的宽度有关，只有加减法运算和二进制除法，既缩减了系统资源又大大节省了运算时间，实现了高效的实时处理。对数字调制解调模块，重点研究和完成了2ASK和2FSK的调制解调的FPGA实现，模块有很好的通用性，能方便地移植到其它的系统中。在文章的最后还对整个系统进行了Matlab仿真，验证了系统设计思想的正确性。在系统各个关键模块的设计过程中，都是先依据一定的设计指标进行verilog编程，然后再在Quartus软件中编译，时序仿真测试，并与Matlab仿真结果进行对比，验证设计的正确性。
上传时间： 2013-05-18
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本文对G.729语音编码算法的基本原理和实现系统开发方面进行了深入研究。针对G.729语音编码算法在实际应用中存在的一些问题，在大量分析和实验的基础上，提出了新的改进算法。G.729语音编码算法硬件实现方面，国内外现在主要以DSP为实现平台，这是由于DSP以其卓越的运算能力为数字语音信号处理领域的研究及开发提供了有力的工具。但G.729语音编码算法具有计算复杂和数据存储量大的固有缺陷，随着通信量的不断增加和服务的扩展，对G.729语音编码实时性的要求也越来越高。随着微电子制造工艺的发展，越来越多的语音编码平台采用DSP与FPGA或MCU相互结合的系统，通过进行软硬件协同设计提高编码效率。
上传时间： 2013-06-30
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在现代电网中，随着超高压、大容量、远距离输电线路的不断增多，对电力系统的安全稳定运行提出了更高、更严格的要求。距离保护作为线路保护的基本组成部分，其工作特性对电力系统的安全稳定运行有着直接和重要的影响。为了适应现代超高压电网稳定运行的要求，微机保护装置在硬件和软件上都提出了越来越高的要求。 高速数字信号处理芯片（DSP）技术的发展，为开发一种速度快、处理能力强的微机保护系统奠定了基础。在这样的背景下，我们采用DSP芯片和ARM处理器，设计了一个并列式双处理器微机保护系统。该系统采用一个DSP芯片负责控制数据采集、采样数据处理，实现保护功能。ARM微处理器承担人机接口管理，通过串行通信方式实现与DSP端口之间的数据通信，丰富的通讯接口，使得与上位机的通讯、下载程序定值灵活方便。新的微机保护装置不断推出，投入运行的微机保护装置不允许用来进行试验、培训，该装置还可作为试验教学系统，供学生学习认识微机保护装置的内部结构，并可自行设计保护算法、编制程序，通过上位机下载到实验装置，完成相应保护功能的测试。 本文实现了微机保护方案的整体软硬件设计，内容包括DSP2812微处理器芯片，ARM7微处理器LPC2220芯片，开关量输入／输出电路、数据采集电路、通讯和网络接口电路、人机界面的显示板电路，文中对各部分电路的功能、特点以及器件的选择、引脚连接进行了详细介绍。系统采用模块化设计，采用双CPU并行处理模式，针对基于LPC2220微处理器的监控管理系统，完成了最小系统设计，详细完成了启动电路的设计。 本文初步设计了人机操作界面，给出了软件设计的流程图，将实时操作系统μC/OS-Ⅱ与模块化硬件设计相结合，共同构成一个可以重复利用的软硬件数字系统平台，除了可以最大限度地提高开发的效率、减少资源的浪费外，还可以通过长期对于该平台的研究，逐步优化平台软硬件资源，提高其性能，并满足日益复杂的应用需求。
上传时间： 2013-04-24
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近年来，随着现代社会对军用和民用设备需求的不断扩大及要求的不断提高，运动目标的识别和跟踪技术已经迅速发展成为现代信息处理领域中一项非常重要的技术，并在许多领域内发挥着不可替代的作用，但是在面向应用的目标跟踪系统却不尽如人意，不能很好的满足应用的要求。 本文简述了传统的基于桌面PC机的目标跟踪系统实现方法。目标跟踪具有两个突出的特点，一是计算数据量大，一是对处理速度要求高。传统上，运动目标跟踪系统的实现是基于桌面PC机，但工业应用的快速发展使传统的目标跟踪系统越来越不能满足应用的需要。 本文提出了一种基于ARM嵌入式平台的目标跟踪解决方案。研究了如何将嵌入式平台和目标跟踪结合起来，并对系统的设计思想和设计方法进行了详述。首先进行了功能分析和总体设计，分析了将嵌入式平台作为目标跟踪解决方案的关键性问题，包括采用ARM嵌入式平台的必要性，系统框架的设计，对于嵌入式处理器和操作系统的选择：然后在总体设计的基础上完成了系统的设计，包括软硬件平台的设计，完成了BootLoader的设计，Linux内核的定制，USB摄像头驱动程序的设计和OpenCV视觉库的建立；最后分析了目标跟踪的过程，利用背景差法实现了运动的检测，提取了行人的特征，利用Mean-Shift算法实现了对运动目标的跟踪。 本文提出的基于嵌入式平台的目标跟踪系统的应用潜力巨大，有待进一步的研究和探索。在论文最后对研究进行了总结和展望，提出了未来的研究方向。
上传时间： 2013-05-27
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随着半导体工艺的飞速发展和芯片设计水平的不断进步，ARM微处理器的性能得到大幅度地提高，同时其芯片的价格也在不断下降，嵌入式系统以其独有的优势，己经广泛地渗透到科学研究和日常生活的各个方面。 本文以ARM7 LPC2132处理器为核心，结合盖革一弥勒计数管对Time-To-Count辐射测量方法进行研究。ARM结构是基于精简指令集计算机(RISC)原理而设计的，其指令集和相关的译码机制比复杂指令集计算机要简单得多，使用一个小的、廉价的ARM微处理器就可实现很高的指令吞吐量和实时的中断响应。基于ARM7TDMI-S核的LPC2132微处理器，其工作频率可达到60MHz，这对于Time-To-Count技术是非常有利的，而且利用LPC2132芯片的定时/计数器引脚捕获功能，可以直接读取TC中的计数值，也就是说不再需要调用中断函数读取TC值，从而大大降低了计数前杂质时间。本文是在我师兄吕军的《Time-To-Count测量方法初步研究》基础上，使用了高速的ARM芯片，对基于MCS-51的Time-To-Count辐射测量系统进行了改进，进一步论证了采用高速ARM处理器芯片可以极大的提高G-M计数器的测量范围与测量精度。 首先，讨论了传统的盖革-弥勒计数管探测射线强度的方法，并指出传统的脉冲测量方法的不足。然后讨论了什么是Time-To-Count测量方法，对Time-To-Count测量方法的理论基础进行分析。指出Time-To-Count方法与传统的脉冲计数方法的区别，以及采用Time-To-Count方法进行辐射测量的可行性。 接着，详细论述基于ARM7 LPC2132处理器的Time-To-Count辐射测量仪的原理、功能、特点以及辐射测量仪的各部分接口电路设计及相关程序的编制。 最后得出结论，通过高速32位ARM处理器的使用，Time-To-Count辐射测量仪的精度和量程均得到很大的提高，对于Y射线总量测量，使用了ARM处理器的Time-To-Count辐射测量仪的量程约为20 u R/h到1R/h，数据线性程度也比以前的Time-To-CotJnt辐射测量仪要好。所以在使用Time-To-Count方法进行的辐射测量时，如何减少杂质时间以及如何提高计数前时间的测量精度，是决定Time-To-Count辐射测量仪性能的关键因素。实验用三只相同型号的J33G-M计数管分别作为探测元件，在100U R/h到lR/h的辐射场中进行试验.每个测量点测量5次取平均，得出随着照射量率的增大，辐射强度R的测量值偏小且与辐射真实值之间的误差也随之增大。如果将测量误差限定在10％的范围内，则此仪器的量程范围为20 u R/h至1R/h，量程跨度近六个数量级。而用J33型G-M计数管作常规的脉冲测量，量程范围约为50 u R/h到5000 u R/h，充分体现了运用Time-To-Count方法测量辐射强度的优越性，也从另一个角度反应了随着计数前时间的逐渐减小，杂质时间在其中的比重越来越大，对测量结果的影响也就越来越严重，尽可能的减小杂质时间在Time-To-Count方法辐射测量特别是测量高强度辐射中是关键的。笔者用示波器测出此辐射仪器的杂质时间约为6.5 u S，所以在计算定时器值的时候减去这个杂质时间，可以增加计数前时间的精确度。通过实验得出，在标定仪器的K值时，应该在照射量率较低的条件下行，而测得的计数前时间是否精确则需要在照射量率较高的条件下通过仪器标定来检验。这是因为在照射量率较低时，计数前时间较大，杂质时间对测量结果的影响不明显，数据线斜率较稳定，适宜于确定标定系数K值，而在照射量率较高时，计数前时间很小，杂质时间对测量结果的影响较大，可以明显的在数据线上反映出来，从而可以很好的反应出仪器的性能与量程。实验证明了Time-To-Count测量方法中最为关键的环节就是如何对计数前时间进行精确测量。经过对大量实验数据的分析，得到计数前时间中的杂质时间可分为硬件杂质时间和软件杂质时间，并以软件杂质时间为主，通过对程序进行合理优化，软件杂质时间可以通过程序的改进而减少，甚至可以用数学补偿的方法来抵消，从而可以得到比较精确的计数前时间，以此得到较精确的辐射强度值。对于本辐射仪，用户可以选择不同的工作模式来进行测量，当辐射场较弱时，通常采用规定次数测量的方式，在辐射场较强时，应该选用定时测量的方式。因为，当辐射场较弱时，如果用规定次数测量的方式，会浪费很多时间来采集足够的脉冲信号。当辐射场较强时，由于辐射粒子很多，产生脉冲的频率就很高，规定次数的测量会加大测量误差，当选用定时测量的方式时，由于时间的相对加长，所以记录的粒子数就相对的增加，从而提高仪器的测量精度。通过调研国内外先进核辐射测量仪器的发展现状，了解到了目前最新的核辐射总量测量技术一Time-To-Count理论及其应用情况。论证了该新技术的理论原理，根据此原理，结合高速处理器ARM7 LPC2132，对以G-计数管为探测元件的Time-To-Count辐射测量仪进行设计。论文以实验的方法论证了Time-To-Count原理测量核辐射方法的科学性，该辐射仪的量程和精度均优于以前以脉冲计数为基础理论的MCS-51核辐射测量仪。该辐射仪具有量程宽、精度高、易操作、用户界面友好等优点。用户可以定期的对仪器的标定，来减小由于电子元件的老化对低仪器性能参数造成的影响，通过Time-To-Count测量方法的使用，可以极大拓宽G-M计数管的量程。就仪器中使用的J33型G-M计数管而言，G-M计数管厂家参考线性测量范围约为50 u R/h到5000 u R/h，而用了Time-To-Count测量方法后，结合高速微处理器ARM7 LPC2132，此核辐射测量仪的量程为20 u R/h至1R/h。在允许的误差范围内，核辐射仪的量程比以前基于MCS-51的辐射仪提高了近200倍，而且精度也比传统的脉冲计数方法要高，测量结果的线性程度也比传统的方法要好。G-M计数管的使用寿命被大大延长。 综上所述，本文取得了如下成果：对国内外Time-To-Count方法的研究现状进行分析，指出了Time-To-Count测量方法的基本原理，并对Time-T0-Count方法理论进行了分析，推导出了计数前时间和两个相邻辐射粒子时间间隔之间的关系，从数学的角度论证了Time-To-Count方法的科学性。详细说明了基于ARM 7 LPC2132的Time-To-Count辐射测量仪的硬件设计、软件编程的过程，通过高速微处理芯片LPC2132的使用，成功完成了对基于MCS-51单片机的Time-To-Count测量仪的改进。改进后的辐射仪器具有量程宽、精度高、易操作、用户界面友好等特点。本论文根据实验结果总结出了Time-To-Count技术中的几点关键因素，如：处理器的频率、计数前时间、杂质时间、采样次数和测量时间等，重点分析了杂质时间的组成以及引入杂质时间的主要因素等，对国内核辐射测量仪的研究具有一定的指导意义。
标签： TimeToCount ARM 辐射测量仪
上传时间： 2013-06-24
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近年来，随着控制系统规模的扩大和总线技术的发展，对数据采集和传输技术提出了更高的要求。目前，很多设备需要实现从单串口通信到多路串口通信的技术改进。同时，随着以太网技术的发展和普及，这些设备的串行数据需要通过网络进行传输，因而有必要寻求一种解决方案，以实现技术上的革新。 本文分别对串行通信和基于TCP/IP协议的以太网通信进行研究和分析，在此基础上，设计一个嵌入式系统一基于APM处理器的多路串行通信与以太网通信系统，来实现F8-DCS系统中多路串口数据采集和以太网之间的数据传输。主要作了如下工作：首先，分析了当前串行通信的应用现状和以太网技术的发展动态，通过比较传统的多路串口通信系统的优缺点，设计出了一种采用CPID技术和CAN总线技术相结合的新型技术，并结合F8-DCS系统数据量大和实时性高的特点，对串行通讯帧同步的方法进行了详细的研究。然后，根据课题的实际需求，对系统进行总体设计和功能模块划分，并详细介绍了基于ARM7处理器的多路串口通信接口、以太网通信接口以及二者之间的数据传输接口的电路设计。在软件设计上，对系统的启动代码、串行通信协议、串口驱动以及多串口与网口间双向数据传输等进行了详细的论述。最后，将上述技术应用于某大型火电厂主机F8-DCS系统I/O通讯网络的测试与分析，达到了设计要求。
上传时间： 2013-07-31
上传用户：aeiouetla
现代自动化生产技术迅猛发展,对保证其产品质量的检测技术也提出了更高的要求,许多传统的检测手段已不能满足现代化大生产的需求.而在计算机视觉理论基础上发展起来的视觉检测技术以其高精度、非接触、自动化程度高等优点满足了现代生产过程在线检测的要求,逐渐由实验室走向工业现场,得到了日益广泛的应用.随着现代生产节拍的不断加快,以及检测节点的增多,处理数据量的增大,对视觉检测系统的测量速度提出了更高的要求,而在现有的检测系统中,实现100％实时在线检测的关键问题是提高视觉图像的处理速度,从而提高整个视觉检测系统的处理速度.因此该文提出基于FPGA的高速图像处理系统的设计方案,得到了国家"十五"攻关项目"光学数码柔性通用坐标测量机"的资助.该文针对以下三个方面进行研究并取得一定的成果:(一)高速图像处理硬件解决方案的研究通过分析现有的几种实现高速图像处理的方法的优缺点,提出了基于现场可编程逻辑器件FPGA(Field Programmable Gate Array)技术的高速图像处理系统的方案,并构建了其硬件平台.(二)基于USB总线的通讯采用USB专用接口芯片,实现高速图像处理系统与PC机的通讯验证硬件设计的正确性.(三)基于FPGA的图像处理的研究分析图像处理的特点及其基本的方法,初步研究了基于FPGA的图像低层次处理的硬件化方法的实现.
上传时间： 2013-04-24
上传用户：tb_6877751
图像采集是数字化图像处理的第一步，开发图像采集平台是视觉系统开发的基础。视觉检测的速度是视觉检测要解决的关键技术之一，也是专用图像处理系统设计所要完成的首要目标
标签： 高速图像采集
上传时间： 2013-04-24
上传用户：waitingfy
基于FPGA的静止图像压缩系统的研究-JPEG编码器的设计电力电子与电力传动数字图像在人们生活中的应用越来越广泛，由于原始图像数据量比较大，因此数字图像压缩技术逐渐成为图像应用的一个核心环节。在数字图像压缩领域，国际标准化组织于1992年推出的JPEG标准应用最为广泛。 本文基于FPGA设计了JPEG图像压缩系统，通过改进算法，优化结构，在合理的利用硬件资源的条件下，有效的挖掘出算法内部的并行性。改进了DCT变换算法，设计了并行查找表结构的乘法器，采用了流水线优化算法来解决时间并行性问题，提高了DCT模块的运算速度。依据Huffman编码表的规律性，采用并行查找表结构，用较少的存储单元完成了Huffman编码运算，同时提高了编码速度。整个设计通过EDA软件进行了逻辑综合及功能与时序仿真。综合和仿真结果表明，本文提出的算法在速度和资源利用方面均达到了较好的状态，可满足实时JPEG图像压缩的要求。 设计了一个硬件开发平台，对JPEG图像压缩系统进行了验证。硬件平台上使用ADV7181B来实现AD转换；使用TI公司TMS320C6416型DSP芯片实现了系统配置以及通过PCI接口与上位机PC的实现数据交换；使用Microsoft VC++6．0开发平台开发了系统控制软件平台，实现对整个压缩系统的控制。
上传时间： 2013-05-24
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针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256 ×128 个像素点,基于相同条件,比静态内存控制的面积大了一倍,验证了动态内存核[7 ]的实用性。
上传时间： 2013-08-21
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