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输出滤波器

输出滤波器,又名“出线滤波器”,是“变频器专用型输出滤波器”的简称。
  • 基于TMS320C6701的扩频通信自适应滤波器

    扩频通信体制在现代通信中的应用越来越广泛。由于扩频码的伪随机性和优良的相关特性,这种体制本身就具有一定的抗干扰性能。但扩频信号的带宽宽,容易受到空间电磁信号和人为发射的恶意信号干扰,干扰信号较强时,需要采取抗干扰措施。针对扩频通信中的窄带干扰,提出了一种基于TMS320C6701的抗干扰自适应滤波器的实现方案,并在其EVM板上进行了实验,取得了较好的抗干扰效果。

    标签: C6701 320C 6701 TMS

    上传时间: 2013-11-18

    上传用户:zl5712176

  • 数字陷波器的设计

    陷波器是无限冲击响应(IIR)数字滤波器,该滤波器可以用以下常系数线性差分方程表示:ΣΣ==−−−=MiNiiiinybinxany01)()()( (1)式中: x(n)和y(n)分别为输人和输出信号序列;和为滤波器系数。 iaib对式(1)两边进行z变换,得到数字滤波器的传递函数为: ΠΠΣΣ===−=−−−==NiiMiiNiiiMiiipzzzzbzazH1100)()()( (2)式中:和分别为传递函数的零点和极点。 izip由传递函数的零点和极点可以大致绘出频率响应图。在零点处,频率响应出现极小值;在极点处,频率响应出现极大值。因此可以根据所需频率响应配置零点和极点,然后反向设计带陷数字滤波器。考虑一种特殊情况,若零点在第1象限单位圆上,极点在单位圆内靠近零点的径向上。为了防止滤波器系数出现复数,必须在z平面第4象限对称位置配置相应的共轭零点、共轭极点。 izip∗iz∗ip这样零点、极点配置的滤波器称为单一频率陷波器,在频率ωo处出现凹陷。而把极点设置在零的的径向上距圆点的距离为l-μ处,陷波器的传递函数为: ))1()()1(())(()(2121zzzzzzzzzHμμ−−−−−−= (3)式(3)中μ越小,极点越靠近单位圆,则频率响应曲线凹陷越深,凹陷的宽度也越窄。当需要消除窄带干扰而不能对其他频率有衰减时,陷波器是一种去除窄带干扰的理想数字滤波器。当要对几个频率同时进行带陷滤波时,可以按(2)式把几个单独频率的带陷滤波器(3)式串接在一起。一个例子:设有一个输入,它

    标签: 数字 陷波器

    上传时间: 2013-10-18

    上传用户:uuuuuuu

  • 用双线性变换法实现IIR数字滤波器

    双线性变换的频率对应关系双线性变换法虽然避免了“频率混叠效应”,但出现了模拟频率与数字频率为一种非线性的关系情形。即:可见:模拟滤波器与数字滤波器的响应在对应的频率关系上发生了“畸变”,也造成了相位的非线性变化,这是双线性变换法的主要缺点。具体而言,在上刻度为均匀的频率点映射到上时变成了非均匀的点,而且随频率增加越来越密。 双线性变换法除了不能用于线性相位滤波器设计外,仍然是应用最为广泛的设计IIR数字滤波器的方法。

    标签: IIR 双线性变换 数字滤波器

    上传时间: 2013-10-12

    上传用户:aysyzxzm

  • 一阶IIR数字滤波器时域滤波效果模拟

    一阶IIR数字滤波器时域滤波效果模拟tzl1963摘要- 供初学如何设计实际的数字滤波器参考。一,基本概念FIR Filter-有限长单位脉冲响应滤波器,传递函数:Σ−=−=10)()(NnnznhzH ; (1))(nh是一个有限长序列。IIR Filter-无限长单位脉冲响应滤波器,传递函数: ΣΣ=−=−−=NiiNiizbzazH01011)( ; (2)二,冲激响应不变法设模拟滤波器的冲激响应是h,取样周期是T,则它的取样冲击响应是。又设数字滤波器的冲击响应是。如果让 )(tA)(n)(nThAh)(nh= (3) )(nThA这就是冲激响应不变法,物理概念就是让数字滤波器的冲激响应等于对应的模拟滤波器冲激响应的抽样函数。模拟滤波器的传递函数是它的冲激函数的拉氏变换,数字滤波器的传递函数的它的冲激函数的z变换。

    标签: IIR 数字滤波器 时域 滤波

    上传时间: 2013-11-20

    上传用户:gaome

  • 一种在FPGA上实现的FIR滤波器的资源优化算法

    在数字滤波器中,FIR滤波器是一种结构简单且总是稳定的滤波器,同时也只有FIR滤波器拥有线性相位的特性。传统的直接型滤波器运算速度过慢,而改进型的DA结构的滤波器需要过高的芯片面积消耗大量的逻辑资源很难达到运算速度以及逻辑资源节约的整体优化。本文提出了一种基于RAG算法的FIR滤波器,与传统的基于DA算法的滤波器结构的滤波器相比,RAG算法简化了FIR滤波器乘法模块的结构,减少了逻辑资源的消耗和硬件实现面积,提高了计算速度。本文设计的16阶FIR滤波器用VerilogHDL进行描述,并综合到Altera公司的CycloneⅡ系列FPGA中。仿真实验表明基于RAG算法的FIR滤波器达到了逻辑资源的节约和运算速度的提高的整体优化效果。

    标签: FPGA FIR 滤波器 优化算法

    上传时间: 2014-12-28

    上传用户:feilinhan

  • 基于Xilinx FPGA的多分辨率频谱分析仪设计

      频谱分析仪的主要工作原理   接收到的中频模拟信号经过A/D转换为14位的数字信 号,首先对数字信号进行数字下变频(DDC),得到I路、Q路信号,然后根据控制信号对I路、Q路信号进行抽取滤波,使用CIC抽取滤波器完成,然后在分 别对I路、Q路信号分别进行低通滤波,滤波器采用FIR滤波器和半带滤波器相结合的方式,然后对信号进行加窗、FFT(对频谱进行分析时进行FFT运算, 对功率谱进行分析时不进行FFT运算)、I路和Q路平方求和、求平均。最后将输出的数据送入到DSP中进行显示与控制的后续处理。

    标签: Xilinx FPGA 多分辨率 频谱分析仪

    上传时间: 2013-10-19

    上传用户:几何公差

  • 基于FPGA设计的FIR滤波器的实现与对比

    描述了基于FPGA的FIR滤波器设计。根据FIR的原理及严格线性相位滤波器具有偶对称的性质给出了FIR滤波器的4种结构,即直接乘加结构、乘法器复用结构、乘累加结构、DA算法。在本文中给出上述几种算法的结构框图,并通过FPGA编程实现上述几种算法,并给出所用的资源来比较各种算法的优劣。

    标签: FPGA FIR 滤波器 对比

    上传时间: 2013-12-09

    上传用户:lvzhr

  • 基于FPGA的四阶IIR数字滤波器

    基于FPGA的四阶IIR数字滤波器

    标签: FPGA IIR 数字滤波器

    上传时间: 2013-10-17

    上传用户:fanxiaoqie

  • 基于fpga的cic滤波器的设计

    软件无线电中 基于FPGA的 CIC抽取滤波器的 设计 主要目的用于给高速信号进行减速处理

    标签: fpga cic 滤波器

    上传时间: 2014-12-28

    上传用户:chukeey

  • 基于FPGA的FIR数字滤波器算法实现

    基于FPGA的FIR数字滤波器算法实现

    标签: FPGA FIR 数字滤波器 算法

    上传时间: 2013-11-12

    上传用户:xz85592677