载频设计

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时钟基准模块主要是为了产生1Hz的方波信号，作为测频控制模块的时钟输入。系统的基准时钟输入为20MHz/256=78125Hz,所以为得到1Hz的时钟信号，必须对输入时钟进行78125次分频。由于是奇数倍分频，可利用时钟下降沿比上升沿延迟半...

2025-05-13 9 载频设计

基于multisim设计的数字频率计电路，能够对1HZ-1KHz三角波方波正弦波进行频率计数，对设计数字频率计电路很有帮助。

2022-11-01 8 载频设计

传统的FFT实现方法首先是对低中频信号进行ADC低采样率采样，然后将采样数据保存在RAM中；当数据足够后，进行FFT运算，将获得的频谱数据显示在屏幕上。这种FFT方法可以说是简单易行，但在处理宽带高中频信号方面，由于受NyquiST采样定理...

2024-08-23 7 载频设计