CPLD 在多路高速同步数据采集系统中的应用
采用VHDL 语言设计,用CPLD 控制模/ 数转换电路, 完成多路模拟输入的高速同步数/ 模转换,具有容错和自检能力。CPLD 与处理器之间采用并行接口,具有很好的移植性、可靠性。
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采用VHDL 语言设计,用CPLD 控制模/ 数转换电路, 完成多路模拟输入的高速同步数/ 模转换,具有容错和自检能力。CPLD 与处理器之间采用并行接口,具有很好的移植性、可靠性。
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