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赛灵思

Xilinx(赛灵思)是全球领先的可编程逻辑完整解决方案的供应商。Xilinx研发、制造并销售范围广泛的高级集成电路、软件设计工具以及作为预定义系统级功能的IP(IntellectualProperty)核。
  • WP312 - 赛灵思新一代28nm FPGA技术概览

        赛灵思选用 28nm 高介电层金属闸 (HKMG) 高性能低 功耗技术,并将该技术与新型一体化 ASMBLTM 架构相结合,从而推出能降低功耗、提高性能的新一代FPGA。这些器件实现了前所未有的高集成度和高带宽,为系统架构师和设计人员提供了一种可替代 ASSP和 ASIC 的全面可编程解决方案。

    标签: FPGA 312 WP 28

    上传时间: 2013-11-07

    上传用户:zengduo

  • WP380 -赛灵思堆叠硅片互联技术

        可编程技术势在必行 — 用更少的资源实现更多功能 随时随地降低风险、使用可编程硬件设计平台快速开发差异化产品 — 驱使人们不断探索能够提供更大容量、更低功耗和更高带宽的 FPGA 解决方案,用来创建目前 ASIC 和 ASSP 所能提供的系统级功能。赛灵思已经开发出一种创新型 FPGA 设计和制造方法,能够满足“可编程技术势在必行”的两大关键要求。堆叠硅片互联技术是新一代 FPGA 的基础,不仅超越了摩尔定律,而且实现的功能能够满足最严格的设计要求。利用该技术,赛灵思缩短了批量交付最大型 FPGA 所需的时间,从而可以满足最终客户的批量生产需求。本白皮书将探讨促使赛灵思开发堆叠硅片互联技术的技术及经济原因,以及使之实现的创新方法。

    标签: 380 WP 赛灵思 堆叠硅片

    上传时间: 2013-10-24

    上传用户:Yue Zhong

  • WP373-赛灵思推出Virtex-7,Kintex-7,Artix-7三大全新系列FPGA

        赛灵思推出的三款全新产品系列不仅发挥了台积电28nm 高介电层金属闸 (HKMG) 高性能低功耗 (HPL) 工艺技术前所未有的功耗、性能和容量优势,而且还充分利用 FPGA 业界首款统一芯片架构无与伦比的可扩展性,为新一代系统提供了综合而全面的平台基础。目前,随着赛灵思 7 系列 (Virtex®-7、Kintex™-7 和Artix™-7 系列) 的推出,赛灵思将系统功耗、性价比和容量推到了全新的水平,这在很大程度上要归功于台积电 28nm HKMG 工艺出色的性价比优势以及芯片和软件层面上的设计创新。结合业经验证的 EasyPath™成本降低技术,上述新系列产品将为新一代系统设计人员带来无与伦比的价值

    标签: Virtex Kintex Artix FPGA

    上传时间: 2015-01-02

    上传用户:shuizhibai

  • 赛灵思的如何撰写测试平台的挺好的文档

    赛灵思的如何撰写测试平台的挺好的文档,不过是英文的

    标签: 赛灵思 测试平台 文档

    上传时间: 2013-12-31

    上传用户:稀世之宝039

  • 赛灵思的FPGA

    赛灵思的FPGA,设计的软核microblaze示例

    标签: FPGA 赛灵思

    上传时间: 2017-03-13

    上传用户:libinxny

  • 赛灵思 FPGA 设计时序

    赛灵思 FPGA 设计时序:作为赛灵思用户论坛的定期访客(见 http://forums.xilinx.com),我注意到新用 户往往对时序收敛以及如何使用时序约束 来达到时序收敛感到困惑。为帮助 FPGA 设计新手实现时序收敛,让我们来深入了 解时序约束以及如何利用时序约束实现 FPGA 设计的最优结果。

    标签: FPGA 赛灵思 计时

    上传时间: 2016-12-14

    上传用户:bigbibby

  • 赛灵思7系列FPGA芯片手册

    赛灵思芯片手册,介绍的很详细。包含芯片资源情况、电气特性、物理结构介绍的很详细。

    标签: FPGA

    上传时间: 2022-04-20

    上传用户:bluedrops

  • 赛克思书店销售管理系统.可用于二次开发,以C++与sql 写.

    赛克思书店销售管理系统.可用于二次开发,以C++与sql 写.

    标签: sql 销售 管理系统 二次开发

    上传时间: 2017-06-27

    上传用户:3到15

  • ispLEVER Classic0

    在为所有 Xilinx® Virtex®-6 和 Spartan®-6 FPGA 产品系列提供全面生产支持的同时,ISE 12 版本作为业界唯一一款领域专用设计套件,不断发展和演进,可以为逻辑、数字信号处理(DSP)、嵌入式处理以及系统级设计提供互操作性设计流程和工具配置。此外,赛灵思还在 ISE 12 套件中采用了大量软件基础架构,并改进了设计方法,从而不仅可缩短运行时间,提高系统集成度,而且还能在最新一代器件产品系列和目标设计平台上扩展 IP 互操作性

    标签: ispLEVER Classic0

    上传时间: 2013-07-26

    上传用户:青春给了作业95

  • Xilinx UltraScale:为您未来架构而打造的新一代架构

      Xilinx UltraScale™ 架构针对要求最严苛的应用,提供了前所未有的ASIC级的系统级集成和容量。    UltraScale架构是业界首次在All Programmable架构中应用最先进的ASIC架构优化。该架构能从20nm平面FET结构扩展至16nm鳍式FET晶体管技术甚至更高的技术,同 时还能从单芯片扩展到3D IC。借助Xilinx Vivado®设计套件的分析型协同优化,UltraScale架构可以提供海量数据的路由功能,同时还能智能地解决先进工艺节点上的头号系统性能瓶颈。 这种协同设计可以在不降低性能的前提下达到实现超过90%的利用率。   UltraScale架构的突破包括:   • 几乎可以在晶片的任何位置战略性地布置类似于ASIC的系统时钟,从而将时钟歪斜降低达50%   • 系统架构中有大量并行总线,无需再使用会造成时延的流水线,从而可提高系统速度和容量   • 甚至在要求资源利用率达到90%及以上的系统中,也能消除潜在的时序收敛问题和互连瓶颈   • 可凭借3D IC集成能力构建更大型器件,并在工艺技术方面领先当前行业标准整整一代   • 能在更低的系统功耗预算范围内显著提高系统性能,包括多Gb串行收发器、I/O以及存储器带宽   • 显著增强DSP与包处理性能   赛灵思UltraScale架构为超大容量解决方案设计人员开启了一个全新的领域。

    标签: UltraScale Xilinx 架构

    上传时间: 2013-11-17

    上传用户:皇族传媒