异步FIFO控制器的设计 主要用于异步先进先出控制器的设计。 所用语言Verilog HDL.
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语言设计技术资料
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D触发器的设计 主要用在时序电路中。 所用语言为Verilog HDL.
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用一位全加器组成四位全加器. 所用语言是Verilog HDL. 主要用在加法器的设计中。
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指令译码电路的设计。 主要用在数字电路的设计中。 所用语言为Verilog HDL.
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VB制作简单模拟器教程入门版 书籍语言： 简体中文 书籍类型： 程序设计 授权方式： 免费软件 书籍大小： 66 KB
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C++Builder6.0界面实例开发 书籍语言： 简体中文 书籍类型： 程序设计 授权方式： 免费软件 书籍大小： 353 KB
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微软研发致胜策略 书籍语言： 简体中文 书籍类型： 程序设计 授权方式： 免费软件 书籍大小： 1.33 MB
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