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　　第1章数字系统EDA设计概论　　第2章可编程逻辑器件设计方法　　第3章 VHDL语言基础　　第4章数字逻辑单元设计　　第5章数字系统高级设计技术（*）　　...

📅 2013-11-01

卷积码的C源程序，包括编码器和译码器。还有一个是循环荣誉校验的vhdl]源码。...

📅 2015-04-15

duda的模式分类作业源代码，第二章上机练习第2题。2类问题的分类器设计。c语言编程。...

📅 2013-12-22

EWB做的多功能数字钟由振荡器输出稳定的高频脉冲信号作为时间基准，经分频器输出标准的秒脉冲，秒计数器满60向分计数器进位，分计数器满60向小时计数器进位，小时计数器按“12翻1”规律计数，计数器...

📅 2015-08-06

将4MHz的访波输入到ccc模块上，输出500Hz提供鸣叫声频。1kHz的方波经fen10模块进行十分频后为秒模块mian、分模块mina、时模块hour，提供时钟信号；用sst模块为整点报时提供控制...

📅 2014-12-22

1.高精度数字秒表（0.01秒的vhdl语言实现） 2.具有定时，暂停，按键随机存储，翻页回放功能； 3.对30M时钟分频产生显示扫描时钟 4.精度高达0.01s,并且可以通过改变主频来更改分...

📅 2015-08-16

密码锁的VHDL实现，分为几个部分。包括除颤抖电路，译码器，等...

📅 2014-12-20

使用hspice平台，混频器设计源码，频域到300兆。...

📅 2013-12-08

目录结构 ├─WuYuFei ├─WuYufei_matlab ├─cap_turbo ├─mother └─paper constituent_decoder_SemiTh.m co...

📅 2015-10-15

本程序以XILINX公司的ISE８.２为开发平台，采用VHDL为开发语言，实现了一个简单的译码器，适合处学者...

📅 2015-11-03

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