本文使用实例描述了在 FPGA/CPLD 上使用 VHDL 进行分频器设 计
本文使用实例描述了在 FPGA/CPLD 上使用 VHDL 进行分频器设 计，包括偶数分频、非 50％占空比和 50％占空比的奇数分频、半整数 （N+0.5）分频、小数分频、分数分频以及积分分频。所有实现均可 通过 Synplify Pro 或 FPGA 生产厂商的综合器进行综合，形成可使 ...
计步器技术资料
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💻 源代码：55717
🔌 电路图：1
计步器一种计量工具，是通过统计步数、距离、速度、时间等数据，测算卡路里或热量消耗，用以掌控运动量，防止运动量不足，或运动过量。
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FIQ有FIQ_PWM、FIQ_TMA和FIQ_TMB三个中断源,当定时器A或B计满溢出时产生中断请求信号TA_TIMEOUT_INT或TA_TIMEOUT_INT,CPU响应后进入中断执行相应的子程序控制二极管发光。A口的低四位接LED灯，B口的低四位接LED灯....
自己写的一个调试器模型的源码, 有单步功能和反汇编引擎.
自己写的一个调试器模型的源码, 有单步功能和反汇编引擎....
一个ＤＤＳ前端的串口通讯编程的程序。可以实现分频和指定步进的计数。计到终点值就锁定频率。
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